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龍芯處理器IP核的FPGA驗(yàn)證平臺設(shè)計

作者：時間：2013-06-16 來源：網(wǎng)絡(luò)

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ck約束技術(shù)和人工干預(yù)布局布線，以達(dá)到預(yù)期目的。使用該平臺對所開發(fā)的SoC的各個模塊進(jìn)行了驗(yàn)證，并在lO MHz～70 MHz條件下與代碼前（后）仿真結(jié)果和SoC實(shí)測結(jié)果進(jìn)行了比較，發(fā)現(xiàn)該FPGA驗(yàn)證平臺在多模塊、高速情況下，性能有所下降，如圖6所示，需進(jìn)一步提高綜合和布局布線技術(shù)。

圖6各模塊實(shí)驗(yàn)驗(yàn)證結(jié)果比較

本文設(shè)計了基于國產(chǎn)龍芯I號處理器IP核的SoC的FPGA驗(yàn)證平臺，介紹了怎樣利用該平臺進(jìn)行軟硬件協(xié)同設(shè)計、SoC系統(tǒng)移植、IP核驗(yàn)證和運(yùn)行實(shí)時操作系統(tǒng)。在電壓設(shè)計、模塊選用甚至處理器核的選用方面都考慮了升級擴(kuò)展技術(shù)，可為其他SoC的驗(yàn)證所借鑒。驗(yàn)證結(jié)果表明，基于龍芯I號CPU IP核的SoC可成功運(yùn)行Linux嵌入式程序及VxWorks。

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