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EEPW首頁(yè) >> 主題列表 >> 實(shí)現(xiàn)

實(shí)現(xiàn)物聯(lián)網(wǎng)的五大核心技術(shù)

  • 從物聯(lián)網(wǎng)的定義及各類技術(shù)所起的作用來(lái)看，物聯(lián)網(wǎng)的關(guān)鍵核心技術(shù)應(yīng)該是無(wú)線傳感器網(wǎng)絡(luò)（WSN）技術(shù)，主要原因是：WSN技術(shù)貫穿物聯(lián)網(wǎng)的全部三個(gè)層次，是其它層面技術(shù)的整合應(yīng)用，對(duì)物聯(lián)網(wǎng)的發(fā)展有提綱挈領(lǐng)的作用。WSN技
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用單片機(jī)實(shí)現(xiàn)溫度遠(yuǎn)程顯示

  • 引 言目前檢測(cè)溫度一般采用熱電偶或熱敏電阻作為傳感器。這種傳感器至儀表之間一般都要用專用的溫度補(bǔ)償導(dǎo)線；而溫度補(bǔ)償導(dǎo)線價(jià)格很貴，并且線路太長(zhǎng)也會(huì)影響測(cè)量精度。在實(shí)際應(yīng)用中往往需要對(duì)較遠(yuǎn)處（1 km左右）的溫
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基于LTCC的DFM方法來(lái)實(shí)現(xiàn)一次設(shè)計(jì)成功

  • 低溫共燒陶瓷(LTCC)電路技術(shù)支持緊湊型多層設(shè)計(jì)并被廣泛用于無(wú)線應(yīng)用，特別是在RF模塊和包內(nèi)系統(tǒng)(SiP)設(shè)計(jì)中。相對(duì)于層壓技術(shù)，它具有一系列優(yōu)勢(shì)，盡管其工藝與層壓印刷電路板材料的處理工藝類似。其典型好處是較低的
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用FPGA實(shí)現(xiàn)Nios II嵌入式系統(tǒng)配置技術(shù)

  • 用FPGA實(shí)現(xiàn)Nios II嵌入式系統(tǒng)配置技術(shù),現(xiàn)場(chǎng)可編程門陣列(FPGA，F(xiàn)ield Programmable Gate Array)是一種高密度可編程邏輯器件，其邏輯功能是通過(guò)把設(shè)計(jì)生成的數(shù)據(jù)文件配置進(jìn)芯片內(nèi)部的靜態(tài)配置數(shù)據(jù)存儲(chǔ)器(SRAM )來(lái)實(shí)現(xiàn)的，具有可重復(fù)編程性，可以靈活實(shí)現(xiàn)各
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礦用應(yīng)力傳感器設(shè)計(jì)與實(shí)現(xiàn)

  • 摘要：在此設(shè)計(jì)并實(shí)現(xiàn)了一種新型應(yīng)力傳感器，采用MSP430單片機(jī)硬件結(jié)構(gòu)，在應(yīng)力傳感器中加入了電子羅盤，可求出傳感器安裝時(shí)的方位角。利用地應(yīng)力計(jì)算公式，可確定煤層中或巖石中應(yīng)力值狀態(tài)。多個(gè)測(cè)點(diǎn)應(yīng)力傳感器可以
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單片機(jī)雙串口同時(shí)通訊的實(shí)現(xiàn)

  • 1　系統(tǒng)的體系結(jié)構(gòu)1．1　系統(tǒng)要求與總體方案設(shè)計(jì)該系統(tǒng)中有單相、三相、機(jī)械式和電子式等各種型號(hào)電能表，要求實(shí)時(shí)、準(zhǔn)確、快速、可靠地采集各分散電能表的用電量數(shù)據(jù)，適應(yīng)各種復(fù)雜的工業(yè)生產(chǎn)現(xiàn)場(chǎng)條件，連續(xù)運(yùn)行、操
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在SX系列單片機(jī)上實(shí)現(xiàn)的虛擬技術(shù)

  • 虛擬技術(shù)是計(jì)算機(jī)應(yīng)用的一個(gè)重要方面，單片機(jī)(MCU)領(lǐng)域也不例外。虛擬技術(shù)是計(jì)算機(jī)對(duì)真實(shí)情況的軟件模擬。多年來(lái)，在單片機(jī)的應(yīng)用中，虛擬技術(shù)也曾零星 的用于外設(shè)接口或功能單元的時(shí)序模擬、狀態(tài)模擬以及控制模擬上
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基于單片機(jī)的高速信號(hào)測(cè)試接口板的實(shí)現(xiàn)

  • 在數(shù)字電路設(shè)計(jì)和調(diào)試中，對(duì)設(shè)計(jì)單元電路的性能進(jìn)行實(shí)時(shí)測(cè)試是必不可少的環(huán)節(jié)。很多情況下，需要通過(guò)計(jì)算機(jī)的比較和分析，來(lái)測(cè)試設(shè)計(jì)的電路的性能是否達(dá)到要求。這就需要設(shè)計(jì)一個(gè)測(cè)試接口板，將計(jì)算機(jī)產(chǎn)生的測(cè)試數(shù)據(jù)
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基于DSP的FPGA配置方法研究與實(shí)現(xiàn)

  • 基于DSP的FPGA配置方法研究與實(shí)現(xiàn),摘要：在數(shù)字電路中，F(xiàn)PGA+DSP的系統(tǒng)結(jié)構(gòu)應(yīng)用日益廣泛。為了減小此種結(jié)構(gòu)的體積和降低成本，對(duì)FPGA采用了被動(dòng)并行的配置方式。上電后，DSP首先完成自身程序的加載，之后充當(dāng)配置FPGA的主處理器，從FLASH芯片中讀取FP
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利用USBUART橋接器實(shí)現(xiàn)單片機(jī)在線編程

  • 引 言：通用串行總線(USB)是一種支持即插即用的新型串行接口，使外設(shè)到計(jì)算機(jī)的連接更加高效便利。這種接口適合于多種設(shè)備，不僅具有快速、即插即用、支持熱插拔的特點(diǎn)，還能同時(shí)連接多達(dá)127個(gè)設(shè)備，解決了如資源沖突
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高速網(wǎng)絡(luò)流量監(jiān)測(cè)系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

  • 　隨著互聯(lián)網(wǎng)技術(shù)的快速發(fā)展，網(wǎng)絡(luò)應(yīng)用范圍不斷擴(kuò)大，網(wǎng)絡(luò)結(jié)構(gòu)和網(wǎng)絡(luò)應(yīng)用越來(lái)越復(fù)雜，這使得網(wǎng)絡(luò)出現(xiàn)各種問(wèn)題的可能性增大，同時(shí)管理網(wǎng)絡(luò)的難度也增大。網(wǎng)絡(luò)流量監(jiān)測(cè)提供了一種探索實(shí)際環(huán)境中網(wǎng)絡(luò)特性的手段。從實(shí)現(xiàn)
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基于單片機(jī)實(shí)現(xiàn)FPGA的加載配置

  • 隨著電子技術(shù)的發(fā)展，數(shù)字系統(tǒng)的設(shè)計(jì)正朝著速度快、容量大、體積小、重量輕的方向發(fā)展。高密度現(xiàn)場(chǎng)可編程邏輯器件的出現(xiàn)將大量邏輯功能集成于一個(gè)單片 IC之中。對(duì)基于 E2PROM (或 Flash Memory)工藝的器件，配置數(shù)據(jù)
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基于80C196KC與PSD4235G2在線編程的實(shí)現(xiàn)

  • 隨著MCU的廣泛應(yīng)用，其性能不斷提高，集成度也日益提高。傳統(tǒng)的MCU系統(tǒng)設(shè)計(jì)，在選好MC U后還要采購(gòu)大量的分離器件（如地址鎖存器、譯碼器、擴(kuò)展芯片、RAM，EPROM，PLD等），使系統(tǒng)復(fù)雜度高、可靠性低，且調(diào)試繁瑣、效
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用AVR匯編語(yǔ)言實(shí)現(xiàn)AES及其優(yōu)化

  • 摘要 AES是美國(guó)高級(jí)加密標(biāo)準(zhǔn)算法,將在未來(lái)幾十年里代替DES在各個(gè)領(lǐng)域中得到廣泛應(yīng)用。本文在研究分析AES加密算法原理的基礎(chǔ)上,著重說(shuō)明算法的實(shí)現(xiàn)步驟,并結(jié)合AVR匯編語(yǔ)言完整地實(shí)現(xiàn)AES加密和解密。根據(jù)AES原理,提出幾
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在Nexar上實(shí)現(xiàn)RTOS51的嵌入式系統(tǒng)方法介紹

  • 在Nexar上實(shí)現(xiàn)RTOS51的嵌入式系統(tǒng)方法介紹,構(gòu)建基于RTOS51操作系統(tǒng)的嵌入式軟件工程
    在Nexar中創(chuàng)建基于RTOS的嵌入式系統(tǒng)工程，需要?jiǎng)?chuàng)建一個(gè)嵌入式工程，其中包括一個(gè)用戶配置文件（user.oil），用戶設(shè)計(jì)源文件（*.c，*.h）；并在系統(tǒng)配置選項(xiàng)中設(shè)定編輯，編譯
  • 關(guān)鍵字： 方法  介紹  系統(tǒng)  嵌入式  實(shí)現(xiàn)  RTOS51  Nexar  
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實(shí)現(xiàn)介紹

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