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BittWare用FPGA實現(xiàn)I/O開關量大于5Gbps

  • 　　BittWare是混合(DSP和FPGA)電路板級方案供應商，日前該公司采用ADI的TigerSHARC及Altera的FPGA技術，推出ATLANTiS Rev 2.0(新TigerSHARC使用的高級傳輸鏈路架構)、I/O切換和處理器件。 　　ATLANTiS采用FPGA實現(xiàn)，便于板外I/O通訊路由和處理，允許系統(tǒng)設計師們設置并動態(tài)連接。所有輸入和輸出均通過ATLANTiS進行路由，每簇通信量大于5GBps。ATLANTiS集成了DSP、PCI橋、PMC接口和I/O外設及板載F
  • 關鍵字： 5Gbps  BittWare  FPGA  I/O  

用FPGA控制CLC5958型A/D轉換器實現(xiàn)的高速PCI數(shù)據(jù)采集卡

世強推出SILABS MCU開發(fā)工具送鼠標

  •     Silicon Laboratories的MCU將高性能的模擬技術（高達24bit A/D， 12bit D/A） 與最快（高達100 MIPS）的兼容MCS-51指令的8位CPU集成在一起，最小為3x3mm的封裝，除具備8位單片機的通用特點外，更有無與倫比的CrossBar功能：動態(tài)的實時I/O配置，允許多個資源控制器分時共享同一I/O，圖形化的單片機資源配置，自動生成匯編或Ｃ的代碼，為各應用領域用戶提供充
  • 關鍵字： MCU  SILABS  世強  

用32位MCU設計應用系統(tǒng)時的軟硬件考慮

  • 在過去的二十年當中，隨著交通工具復雜性的日益增加，工程師已將ECU從8位MCU升級為16位以上的器件。目前，這樣一 ...
  • 關鍵字： MCU  32位  應用設計  汽車引擎控制單元  

海思半導體新推出8位MCU用于IC卡

  • 　　海思半導體公司日前推出硬件加密8位微控制器Hi9102E321X V1.0，內置64K ROM及32K EEPROM，據(jù)稱是提供高效、高安全性及低功耗特性，適用于SIM卡、UIM卡、社?？?、付費電視卡、銀行卡、加油卡、校園卡等應用。 　　該微控制器CPU與標準的8051完全兼容，外部時鐘頻率支持1MHz～5MHz，大多數(shù)指令在一個時鐘周期完成，并提供內部時鐘倍頻器，支持1x、2x、4x倍頻。內置的EEPROM具有50萬次的擦寫能力，其中的數(shù)據(jù)可以保存10年時間，EEPRO
  • 關鍵字： IC卡  MCU  半導體  海思  

采用FPGA的低功耗系統(tǒng)設計

  • 　　結合采用低功耗元件和低功耗設計技術在目前比以往任何時候都更有價值。隨著元件集成更多功能，并越來越小型化，對低功耗的要求持續(xù)增長。當把可編程邏輯器件用于低功耗應用時，限制設計的低功耗非常重要。本文將討論減小動態(tài)和靜態(tài)功耗的各種方法，并且給出一些例子說明如何使功耗最小化。  　　功耗的三個主要來源是啟動、待機和動態(tài)功耗。器件上電時產(chǎn)生的相關電流即是啟動電流；待機功耗又稱作靜態(tài)功耗，是電源開啟但I/O上沒有開關活動時器件的功耗；動態(tài)功耗是指器件正常工作時的功耗。  　　啟動電流因器件而異
  • 關鍵字： FPGA  嵌入式  消費電子  

使用Verilog實現(xiàn)基于FPGA的SDRAM控制器

  • 介紹了SDRAM的特點和工作原理，提出了一種基于FPGA的SDRAM控制器的設計方法，使用該方法實現(xiàn)的控制器可非常方便地對SDRAM進行控制。
  • 關鍵字： Verilog  SDRAM  FPGA  控制器    

利用MCU 設計離線鋰電池充電器

  • 　　高效、低成本及可靠的電池充電器設計可用各種方法來實現(xiàn)，但采用8 位閃速MCU 不僅能縮短設計時間、降低成本及提供安全可靠的產(chǎn)品，而且還能使設計人員以最少的工作量來進行現(xiàn)場升級?？紤]到電池安全充電的成本、設計效率及重要性，基于MCU 的解決方案可為設計者們提供諸多優(yōu)勢。通過選擇帶適當外圍與閃存的8 位MCU，工程師們能充分利用其優(yōu)勢來設計一種離線鋰電池充電器。帶2KB 閃存及適當外圍以提供一種廉價解決方案的飛利浦 80C51 型MCU 就是這樣一個例子。集成化閃存還能提供高效及方便地調試應用代碼并進行現(xiàn)
  • 關鍵字： MCU  電源  

基于FPGA的毫米波多目標信號形成技術的研究

  • 毫米波多目標信號發(fā)生器通過模擬的方法產(chǎn)生多種類型高精度的雷達多目標回波信號，在實際雷達系統(tǒng)前端不具備的條件下對雷達系統(tǒng)后級進行調試，便于制導武器的性能測試，大大加快新武器的研制進程。毫米波多目標信號產(chǎn)生的關鍵是要求回波信號距離分辨率極高，常規(guī)的多目標信號產(chǎn)生方法如使用數(shù)字延時線產(chǎn)生多目標之間的延時，其控制不靈活，并且有些延時線需要接ECL電源，使用不方便也增加了設計的復雜度。使用分立元件實現(xiàn)延時則使電路元件過多，電路的穩(wěn)定性及延時的精確性也會大大降低。本文介紹一種新的產(chǎn)生毫米波雷達模擬器的多目標信號的方法
  • 關鍵字： FPGA  

FPGA 設計的四種常用思想與技巧

  • 　　本文討論的四種常用FPGA/CPLD設計思想與技巧：乒乓操作、串并轉換、流水線操作、數(shù)據(jù)接口同步化，都是FPGA/CPLD 邏輯設計的內在規(guī)律的體現(xiàn)，合理地采用這些設計思想能在FPGA/CPLD設計工作種取得事半功倍的效果。 　　FPGA/CPLD的設計思想與技巧是一個非常大的話題，由于篇幅所限，本文僅介紹一些常用的設計思想與技巧，包括乒乓球操作、串并轉換、流水線操作和數(shù)據(jù)接口的同步方法。希望本文能引起工程師們的注意，如果能有意識地利用這些原則指導日后的設計工作，將取得事半功倍的效果！ 乒乓操作
  • 關鍵字： FPGA  嵌入式  

大型設計中FPGA的多時鐘策略

  • 　　利用FPGA 實現(xiàn)大型設計時，可能需要FPGA 具有以多個時鐘運行的多重數(shù)據(jù)通路，這種多時鐘FPGA 設計必須特別小心，需要注意最大時鐘速率、抖動、最大時鐘數(shù)、異步時鐘設計和時鐘/數(shù)據(jù)關系。設計過程中最重要的一步是確定要用多少個不同的時鐘，以及如何進行布線，本文將對這些設計策略深入闡述。 　　FPGA 設計的第一步是決定需要什么樣的時鐘速率，設計中最快的時鐘將確定FPGA 必須能處理的時鐘速率。最快時鐘速率由設計中兩個觸發(fā)器之間一個信號的傳輸時間P 來決定，如果P 大于時鐘周期T，則當信號在一個觸發(fā)
  • 關鍵字： FPGA  嵌入式  

自適應算術編碼的FPGA實現(xiàn)

  • 　　算術編碼是一種無失真的編碼方法，能有效地壓縮信源冗余度，屬于熵編碼的一種。算術編碼的一個重要特點就是可以按分數(shù)比特逼近信源熵，突破了Haffman編碼每個符號只不過能按整數(shù)個比特逼近信源熵的限制。對信源進行算術編碼，往往需要兩個過程，第一個過程是建立信源概率表，第二個過程是對信源發(fā)出的符號序列進行掃描編碼。而自適應算術編碼在對符號序列進行掃描的過程中，可一次完成上述兩個過程，即根據(jù)恰當?shù)母怕使烙嬆Ｐ秃彤斍胺栃蛄兄懈鞣柍霈F(xiàn)的頻率，自適應地調整各符號的概率估計值，同時完成編碼。盡管從編碼效率上看不如已
  • 關鍵字： FPGA  嵌入式  

HDLC控制協(xié)議的FPGA設計與實現(xiàn)

  • 設計了一種基于ＦＰＧＡ的ＨＤＬＣ協(xié)議控制系統(tǒng)?該系統(tǒng)可有效利用ＦＰＧＡ片內硬件資源，無需外圍電路，高度集成且操作簡單。重點對協(xié)議的ＣＲＣ校驗及“０”比特插入模塊進行了介紹，給出了相應的ＶＨＤＬ代碼及功能仿真波形圖。
  • 關鍵字： HDLC  FPGA  控制協(xié)議    

基于FPGA和USB的高速數(shù)據(jù)傳輸、記錄及顯示系統(tǒng)

  • 提出了一種基于FPGA和USB的高速數(shù)據(jù)傳輸、記錄及顯示系統(tǒng)的設計方案，并對其中的低電壓差分信號（LVDS）傳輸方式、FPGA功能模塊以及USB傳輸模塊等進行了介紹。
  • 關鍵字： FPGA  USB  高速數(shù)據(jù)傳輸  記錄    

基于FPGA的數(shù)字復接系統(tǒng)幀同步器設計與實現(xiàn)

  • 介紹了應用ＦＰＧＡ技術進行幀同步器設計的實現(xiàn)原理、系統(tǒng)框圖及設計中需要注意的問題，給出了用ＶＨＤＬ描述的幾個模塊的源代碼。
  • 關鍵字： FPGA  數(shù)字復接  系統(tǒng)  幀同步器    
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