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基于CPLD的片內(nèi)環(huán)形振蕩器的設(shè)計(jì)方案

  • 本文介紹一種通用的基于CPLD的片內(nèi)振蕩器設(shè)計(jì)方法，它基于環(huán)形振蕩器原理，只占用片上普通邏輯資源(LE)，無(wú)需...
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CPLD在基于PCI總線的功率模塊設(shè)計(jì)中的應(yīng)用

  • 　1 引言　　在機(jī)電一體化控制系統(tǒng)中，直流電機(jī)常用于控制系統(tǒng)的執(zhí)行器，是電機(jī)控制的重要部分，能按照處理器指令驅(qū)動(dòng)電機(jī)運(yùn)轉(zhuǎn)實(shí)現(xiàn)電機(jī)控制。目前直流電機(jī)PWM(pulse width modulation，脈寬調(diào)制)驅(qū)動(dòng)控制方式應(yīng)用最為
  • 關(guān)鍵字： CPLD  PCI  總線  功率模塊    

基于CPLD的模數(shù)轉(zhuǎn)換組合研究

  • 1引言　　

    A/D轉(zhuǎn)換組合是雷達(dá)目標(biāo)諸元數(shù)據(jù)轉(zhuǎn)換、傳輸?shù)暮诵牟考坏┏霈F(xiàn)故障，目標(biāo)信號(hào)將無(wú)法傳送到信息處理中心進(jìn)行處理，從而導(dǎo)致雷達(dá)主要功能失效。某設(shè)備的A/D轉(zhuǎn)換設(shè)備結(jié)構(gòu)復(fù)雜，可靠性差，可維修性差，故障
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基于CPLD的DSP人機(jī)接口模塊設(shè)計(jì)

  • 基于CPLD的DSP人機(jī)接口模塊設(shè)計(jì),　　CPLD(Complex programmable Logic Device，復(fù)雜可編程邏輯器件)是在傳統(tǒng)的PAL、GAL基礎(chǔ)上發(fā)展而來(lái)的，具有多種工作方式和高集成、高速、高可靠性等明顯的特點(diǎn)?！　≡诔咚兕I(lǐng)域和實(shí)時(shí)測(cè)控方面有非常廣泛的應(yīng)用，
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基于比時(shí)法的晶振頻率測(cè)量建模與分析

采用CPLD的MAX1032采樣控制的實(shí)現(xiàn)方法

  • 采用CPLD的MAX1032采樣控制的實(shí)現(xiàn)方法,0 引言
    本文主要介紹MAX1032采樣芯片以及使用CPLD對(duì)MAX1032采樣進(jìn)行控制的方法。事實(shí)上，雖然微控制器也能對(duì)MAX1032進(jìn)行方便的控制，但使用CPLD來(lái)控制系統(tǒng)外圍設(shè)備，可以節(jié)省微控制器的資源，減輕其負(fù)擔(dān)，同時(shí)可
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基于CPLD的片內(nèi)環(huán)形振蕩器的設(shè)計(jì)方案

  • 基于CPLD的片內(nèi)環(huán)形振蕩器的設(shè)計(jì)方案,本文介紹一種通用的基于CPLD的片內(nèi)振蕩器設(shè)計(jì)方法，它基于環(huán)形振蕩器原理，只占用片上普通邏輯資源(LE)，無(wú)需使用專用邏輯資源(如MaxII中的UFM)，從而提高了芯片的資源利用率；振蕩頻率可在一定范圍內(nèi)調(diào)整，振蕩輸出
  • 關(guān)鍵字： 設(shè)計(jì)  方案  振蕩器  內(nèi)環(huán)  CPLD  基于  

基于可編程芯片的軟件無(wú)線電試驗(yàn)平臺(tái)的設(shè)計(jì)

  • 摘要：介紹了軟件無(wú)線電的思想和結(jié)構(gòu)，提出了一種實(shí)現(xiàn)軟件無(wú)線電試驗(yàn)平臺(tái)的設(shè)計(jì)方案，隨后對(duì)各個(gè)模塊進(jìn)行了分析。整個(gè)試驗(yàn)平臺(tái)可以根據(jù)用戶的需求產(chǎn)生各種調(diào)制制式的中頻信號(hào)；也可以接收各種中頻信號(hào)，并變頻成基
  • 關(guān)鍵字： CPLD   無(wú)線  

基于MAX II CPLD 的LCD控制器設(shè)計(jì)

  • 摘要：采用MAX II系列CPLD器件來(lái)實(shí)現(xiàn)LCD控制器。由于MAX II CPLD是唯一具有用戶閃存(UFM)的CPLD，因此用一片CPLD 芯片就可完成LCD全部的時(shí)序控制、顯示控制等功能,這樣無(wú)需再加入其它的接口器件，使微處理器和LCD顯示
  • 關(guān)鍵字： CPLD   LCD  

MAX1032結(jié)合CPLD的應(yīng)用

  • 介紹了14位ADC采樣芯片MAX1032的特性及工作原理，結(jié)合CPLD，給出MAX1032使用外部時(shí)鐘模式由CPLD控制采樣和存儲(chǔ)結(jié)果應(yīng)用方案及CPLD的邏輯設(shè)計(jì)方法。本方案適用于工業(yè)控制，自動(dòng)測(cè)試，數(shù)據(jù)采集等領(lǐng)域。文中同時(shí)給出了使用Verilog編寫(xiě)的CPLD代碼及主要原理圖。
  • 關(guān)鍵字： 1032  CPLD  MAX    

FPGA/CPLD設(shè)計(jì)思想與技巧

  • FPGA/CPLD設(shè)計(jì)思想與技巧,　　本文討論的四種常用FPGA/CPLD設(shè)計(jì)思想與技巧：乒乓操作、串并轉(zhuǎn)換、流水線操作、數(shù)據(jù)接口同步化，都是FPGA/CPLD邏輯設(shè)計(jì)的內(nèi)在規(guī)律的體現(xiàn)，合理地采用這些設(shè)計(jì)思想能在FPGA/CPLD設(shè)計(jì)工作中取得事半功倍的效果?！?/li>
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基于ARM7和CPLD的數(shù)字公交站亭系統(tǒng)設(shè)計(jì)

  • 基于ARM7和CPLD的數(shù)字公交站亭系統(tǒng)設(shè)計(jì), 摘要：提出了一種基于ARM7 和CPLD 架構(gòu)的數(shù)字公交站亭系統(tǒng)。系統(tǒng)通過(guò)GPRS 模塊與公交控制中心實(shí)時(shí)通信，使用CA 認(rèn)證保證通信的安全性，采用兩塊SRAM 組成具有“乒乓邏輯”的高速緩存確保顯示數(shù)據(jù)的連續(xù)性
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基于MAX7000系列CPLD的數(shù)據(jù)采集系統(tǒng)

  • CPLD是復(fù)雜的PLD，專指那些集成規(guī)模大于1000門(mén)以上的可編程邏輯器件。它由與陣列、或陣列、輸入緩沖電路...
  • 關(guān)鍵字： CPLD  MAX7000  數(shù)據(jù)采集  FPGA  
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