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新版Cadence Incisive平臺(tái)可將SoC驗(yàn)證效率提升一倍

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS)，日前公布了一個(gè)新版的尖端功能驗(yàn)證平臺(tái)與方法學(xué)，擁有全套最新增強(qiáng)功能，與之前發(fā)布的版本相比，可將SoC驗(yàn)證效率提高一倍。Incisive ?12.2提供了兩倍性能，全新Incisive調(diào)試分析器產(chǎn)品，全新低功耗建模，以及當(dāng)今復(fù)雜IP與SoC高效驗(yàn)證所需的數(shù)百種其他功能。
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Cadence：做大，更要做強(qiáng)

  • 收購(gòu)是做大的一種途徑。EDA工具業(yè)給人的印象是三大公司稱雄，并購(gòu)案時(shí)有發(fā)生。并購(gòu)使大者恒大，資本、技術(shù)密集。例如Cadence一直在陸續(xù)收購(gòu)。Cadence在埋頭把核心技術(shù)和客戶服務(wù)搞好后，有了充足的盈利就考慮收購(gòu)公司，以給股東帶來(lái)更大的回報(bào)。
  • 關(guān)鍵字： Cadence  設(shè)計(jì)  EDA  

Cadence合成技術(shù)為Renesas微系統(tǒng)公司加快生產(chǎn)時(shí)間

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè) Cadence 設(shè)計(jì)系統(tǒng)公司 (NASDAQ:CDNS) 日前宣布 Renesas 微系統(tǒng)有限公司已采用 Cadence? Encounter? RTL Compiler 用于綜合實(shí)現(xiàn)，尤其是將復(fù)雜 ASIC 設(shè)計(jì)的芯片利用率提高了 15%，面積減少了 8.4%，加速了實(shí)現(xiàn)周期并降低了成本。
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Cadence推出首款以太網(wǎng)汽車(chē)連接性的設(shè)計(jì)IP和驗(yàn)證IP

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence 設(shè)計(jì)系統(tǒng)公司 (NASDAQ:CDNS) 日前宣布將很快推出業(yè)界首款用于最新的汽車(chē)以太網(wǎng)控制器的 汽車(chē)以太網(wǎng)設(shè)計(jì) IP 和 驗(yàn)證 IP (VIP)。 基于標(biāo)準(zhǔn)的設(shè)計(jì) IP 和 VIP 支持由 OPEN Alliance Special Interest Group (SIG) 定義的最新汽車(chē)以太網(wǎng)擴(kuò)展。
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Cadence試產(chǎn)14nm測(cè)試芯片

  • 　　近日，Cadence宣布，運(yùn)用IBM FinFET制程技術(shù)所設(shè)計(jì)的 ARM Cortex-M0 處理器14nm測(cè)試晶片已投入試產(chǎn)。成功投產(chǎn)14nmSOI FinFET 技術(shù)歸功于三家廠商攜手建立的生態(tài)體系，在以 FinFET 為基礎(chǔ)的 14nm設(shè)計(jì)流程中，克服從設(shè)計(jì)到制造的各種新挑戰(zhàn)。 　　14nm生態(tài)系統(tǒng)與晶片是ARM、Cadence與IBM合作在14nm以上的先進(jìn)制程開(kāi)發(fā)系統(tǒng)晶片(SoCs)之多年期協(xié)議的重大里程碑。運(yùn)用FinFET技術(shù)的14nm設(shè)計(jì)SoC實(shí)現(xiàn)了大幅減少耗電的承諾。 　　&ld
  • 關(guān)鍵字： Cadence  芯片  處理器  

Cadence宣布使用ARM和IBM工藝技術(shù)流片14納米測(cè)試芯片

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS)，日前宣布流片了一款14納米測(cè)試芯片，使用IBM的FinFET工藝技術(shù)設(shè)計(jì)實(shí)現(xiàn)了一顆ARM Cortex-M0處理器。這次成功流片是三家技術(shù)領(lǐng)先企業(yè)緊密合作的結(jié)果，他們一起建立了一個(gè)產(chǎn)品體系，解決基于14納米FinFET的設(shè)計(jì)流程中內(nèi)在的從設(shè)計(jì)到生產(chǎn)的過(guò)程中出現(xiàn)的新挑戰(zhàn)。
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Cadence驗(yàn)證IP為ARM AMBA 4協(xié)議大幅縮短驗(yàn)證周轉(zhuǎn)時(shí)間

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS)，日前宣布使用ARM AMBA協(xié)議類型的Cadence驗(yàn)證IP(VIP)實(shí)現(xiàn)多個(gè)成功驗(yàn)證項(xiàng)目，這是業(yè)界最廣泛使用的AMBA協(xié)議系列驗(yàn)證解決方案之一。
  • 關(guān)鍵字： Cadence  ARM  SoC  

Cortex-A50的希望：14nm ARM成功流片

  • 　　電子設(shè)計(jì)企業(yè)Cadence Design Systems, Inc.今天宣布，借助IBM FinFET晶體管技術(shù)，已經(jīng)成功流片了14nm工藝的ARM Cortex-M0處理器試驗(yàn)芯片。 　　 ? 　　Cadence、ARM、IBM三者之間已經(jīng)達(dá)成了多年的合作協(xié)議 　　Cadence、ARM、IBM三者之間已經(jīng)達(dá)成了多年的合作協(xié)議，共同開(kāi)發(fā)14nm以及更先進(jìn)的半導(dǎo)體工藝，14nm芯片和生態(tài)系統(tǒng)就是三方合作的一個(gè)重要里程碑。 　　這次的試驗(yàn)芯片主要是用來(lái)對(duì)14nm工藝設(shè)計(jì)IP的
  • 關(guān)鍵字： Cadence  芯片  FinFET  

Cadence技術(shù)與Allegro Package Designer為掌上消費(fèi)電子市場(chǎng)而優(yōu)化

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence 設(shè)計(jì)系統(tǒng)公司 (NASDAQ: CDNS)，日前宣布其Allegro? 16.6 Package Designer與系統(tǒng)級(jí)封裝(SiP)布局解決方案支持低端IC封裝要求，滿足新一代智能手機(jī)、平板電腦、超薄筆記本電腦的需要。
  • 關(guān)鍵字： Cadence  Allegro  IC封裝  

Cadence簽收解決方案為STMicroelectronics帶來(lái)上市優(yōu)勢(shì)

  • 全球電子設(shè)計(jì)創(chuàng)新Cadence設(shè)計(jì)系統(tǒng)公司 (NASDAQ: CDNS)，日前宣布服務(wù)于廣泛電子應(yīng)用領(lǐng)域的全球半導(dǎo)體領(lǐng)先企業(yè)STMicroelectronics，通過(guò)改用Cadence的簽收解決方案將一款28納米系統(tǒng)級(jí)芯片(SoC)的設(shè)計(jì)周期縮短了數(shù)周時(shí)間。
  • 關(guān)鍵字： Cadence  SoC  

CSR實(shí)現(xiàn)系統(tǒng)加速低功耗、混合信號(hào)芯片流片

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS)宣布，緊湊型、多媒體及云領(lǐng)域的創(chuàng)新芯片及軟件解決方案的全球供應(yīng)商CSR plc (LSE: CSR; NASDAQ: CSRE)使用Cadence Encounter Digital Implementation(EDI)系統(tǒng)、Cadence Incisive Enterprise Simulator(IES)以及Cadence Conformal Low Power(CLP)加速了一款復(fù)雜低功耗、混合信號(hào)芯片的流片。
  • 關(guān)鍵字： Cadence  芯片  CSR  

Cadence推出驗(yàn)證調(diào)試器,實(shí)現(xiàn)顯著的效率提升和時(shí)間節(jié)省

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS)，日前宣布推出Incisive?調(diào)試分析器，這是一款全新的面向RTL、測(cè)試平臺(tái)與SoC驗(yàn)證的創(chuàng)新驗(yàn)證調(diào)試產(chǎn)品，能實(shí)現(xiàn)調(diào)試時(shí)間與資源投入的大幅節(jié)省。
  • 關(guān)鍵字： Cadence  SoC  調(diào)試器  

Cadence推出最新版Allegro印刷電路板(PCB)技術(shù)

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS)，于近日宣布推出最新版Allegro?印刷電路板(PCB)技術(shù)，解決客戶對(duì)于高效產(chǎn)品開(kāi)發(fā)的簡(jiǎn)化解決方案的需要。
  • 關(guān)鍵字： Cadence  PCB  Allegro  

Cadence發(fā)布OrCAD 16.6,PSpice性能提高達(dá)20%

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(納斯達(dá)克：CDNS) 于2012年9月25日發(fā)布了具有一系列新功能的Cadence? OrCAD? 16.6 PCB設(shè)計(jì)解決方案，用戶定制功能增強(qiáng)，模擬性能提高20%， 使用戶得以更快、更有預(yù)見(jiàn)性地創(chuàng)建產(chǎn)品。
  • 關(guān)鍵字： Cadence  OrCAD  

Cadence首個(gè)DDR4 Design IP解決方案在28納米級(jí)芯片上得到驗(yàn)證

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(Cadence Design Systems, Inc.) (NASDQ： CDNS) 日前宣布，Cadence DDR4 SDRAM PHY 和存儲(chǔ)控制器Design IP的首批產(chǎn)品在TSMC的28HPM和28HP技術(shù)工藝上通過(guò)硅驗(yàn)證。
  • 關(guān)鍵字： Cadence  DRAM  DDR4  
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cadence介紹

EDA仿真軟件Cadence -------------------------------------------------------------------------------- Cadence Design Systems Inc.是全球最大的電子設(shè)計(jì)技術(shù)(Electronic Design Technologies)、程序方案服務(wù)和設(shè)計(jì)服務(wù)供應(yīng)商。其解決方案旨在提升和監(jiān)控半導(dǎo) [ 查看詳細(xì) ]

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