1 FIFO概述
　　FIFO芯片是一種具有存儲功能的高速邏輯芯片，可在高速數(shù)字系統(tǒng)中用作數(shù)據(jù)緩存。FIFO通常利用雙口RAM和讀寫地址產(chǎn)生模塊來實現(xiàn)其功能。FIFO的接口信號包括異步寫時鐘（wr-clk）和讀時鐘（rd-clk）、與寫時鐘同步的寫有效（wren）和寫數(shù)據(jù)（wr-data）、與讀時鐘同步的讀有效（rden）和讀數(shù)據(jù)（rd-data）。寫地址產(chǎn)生模塊一般還根據(jù)讀地址和寫地址來產(chǎn)生FIFO的滿標志。讀地址產(chǎn)生模塊一般根據(jù)讀地址和寫地址的差來產(chǎn)生FIFO的空標志。為了實現(xiàn)正確的讀寫和避免FIFO的上溢或下溢，通常還應給出與讀時鐘和寫時鐘同步的FIFO的空標志（empty）和滿標志（full），以禁止讀寫操作。寫地址產(chǎn)生模塊通常根據(jù)寫時鐘和寫有效信號來產(chǎn)生遞增的寫地址，而讀地址產(chǎn)生模塊則根據(jù)讀時鐘和讀有效信號來產(chǎn)生遞增的讀地址。FIFO一般在操作時，首先在寫時鐘wr clk的上升沿且當wren有效時，將wrdata寫入雙口RAM中寫地址對應的位置中，然后將讀地址對應的雙口RAM中的數(shù)據(jù)輸出到讀數(shù)據(jù)總線上，這樣就可實現(xiàn)先進先出功能。讀寫操作一般會自動訪問存儲器中連續(xù)的存儲單元。從FIFO中讀出的數(shù)據(jù)順序與寫入的順序相同，而地址的順序則在內(nèi)部已經(jīng)預先定義好，因此，對FIFO芯片的操作不需要額外的地址信息。另外，F(xiàn)IFO芯片還能提供對讀／寫指針的復位功能。這些結構上的特點使FI－FO的應用大大簡化了電路的復雜程度，提高了系統(tǒng)的可靠性和穩(wěn)定性。由于微電子技術的飛速發(fā)展，新一代FIFO芯片的容量越來越大，體積也越來越小，價格越來越便宜，因而將在高性能、低功耗、快速數(shù)據(jù)處理系統(tǒng)中發(fā)揮越來越重要的作用。

　　2 IDT72V3680簡介

　　2．1 IDT72V3680功能特點

　　IDT72V3680屬于IDT公司的高密度supersyncTMⅡ36位系列存儲器IDT72V3640～3690中的一種，其存儲結構為16，384×36。這一系列CMOS工藝的FIFO（先入先出）芯片具有極大的深度。其基本功能特點如下：

　　對讀／寫口都可進行靈活的總線寬度設置，可選擇不同的輸入／輸出數(shù)據(jù)線寬度（可在36 in 36 out；36 in 18 out；36in 9 out；18 in 36 out；9in 36 out中選擇）；
　　重傳操作延時很低且固定；
　　首字的寫入到讀出的延時很低且固定；
　　數(shù)據(jù)密度高達1Mbit；
　　操作時鐘可達166MHz；
　　可選大／小字節(jié)排列格式；
　　主復位方式可提供FIFO整體清零，部分復位只清掉存儲數(shù)據(jù)，但保留可編程設置項；
　　幾乎空／滿標志置位或無效操作可選擇同步或異步時間模式；
　　具有兩種時間工作模式，分別為IDT標準模式（采用和標志位）和FWFT首字直傳模式（采用標志位）；
　　讀寫操作采用獨立時鐘，并可異步操作；
　　采用TQFP（128引腳）和PBGA（144引腳）兩種封裝形式，其中PBGA封裝形式不僅可用JTAG口提供邊界掃描功能，還可選擇同步或者異步讀寫操作（只對PBGA封裝）；
　　與5V輸入兼容；
　　具有節(jié)電模式；
　　管腳可與更高密度的芯片IDT72V36100和IDT72V36110兼容。