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實驗10:七段數(shù)碼管
- 1. 實驗目的(1)熟悉和掌握FPGA開發(fā)流程和Lattice Diamond軟件使用方法;(2)通過實驗理解和掌握數(shù)碼管驅(qū)動;(3)學習用Verilog HDL描述數(shù)碼管驅(qū)動電路。2. 實驗任務在數(shù)碼管上顯示數(shù)字。3. 實驗原理數(shù)碼管是工程設計中使用很廣的一種顯示輸出器件。一個7段數(shù)碼管(如果包括右下的小點可以認為是8段)分別由a、b、c、d、e、f、g位段和表示小數(shù)點的dp位段組成。實際是由8個LED燈組成的,控制每個LED的點亮或熄滅實現(xiàn)數(shù)字顯示。通常數(shù)碼管分為共陽極數(shù)碼管和共陰極數(shù)碼管,結(jié)構(gòu)如下圖
- 關鍵字: 七段數(shù)碼管 FPGA Lattice Diamond Verilog HDL
HDL仿真器基于事件的仿真算法

- 目前,HDL仿真器主要有三種實現(xiàn)算法(機制):基于時間的算法(Time-Based)、基于事件的算法(Event-Based,EBS)和基于周期的算法(Cycle-Based,CBS) 基于時間的算法適合處理連續(xù)的時間及變量,其會在每一個時間點對所有的電路元件進行計算。但是,在大部分情況下,每一個時間點只有約2%~10%的電路處于活動(運行)狀態(tài),所以該算法效率非常低?! 』谑录乃惴ㄟm合處理離散的時間、狀態(tài)和變量。該算法只有在電路狀態(tài)發(fā)生變化時才進行處理,只仿真那些可能引起電路狀態(tài)改變的元件。仿
- 關鍵字: HDL 仿真器
基于verilog實現(xiàn)哈夫曼編碼的新方法

- 傳統(tǒng)的硬件實現(xiàn)哈夫曼編碼的方法主要有:預先構(gòu)造哈夫曼編碼表,編碼器通過查表的方法輸出哈夫曼編碼[1];編碼器動態(tài)生成哈夫曼樹,通過遍歷節(jié)點方式獲取哈夫曼編碼[2-3]。第一種方法從平均碼長角度看,在很多情況下非最優(yōu);第二種方法需要生成完整的哈夫曼樹,會產(chǎn)生大量的節(jié)點,且需遍歷哈夫曼樹獲取哈夫曼編碼,資源占用多,實現(xiàn)較為麻煩。本文基于軟件實現(xiàn)[4]時,使用哈夫曼樹,會提出一種適用于硬件并行實現(xiàn)的新數(shù)據(jù)結(jié)構(gòu)——字符池,通過對字符池的頻數(shù)屬性比較和排序來決定各個字符節(jié)點在字符池中的歸屬。配置字符池的同時逐步生成
- 關鍵字: verilog 哈夫曼編碼 字符池 FPGA 201712
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