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FPGA實(shí)現(xiàn)的FIR算法在汽車動(dòng)態(tài)稱重儀表中的應(yīng)用

摘要：本文介紹了用FPGA實(shí)現(xiàn)的FIR算法，并對(duì)這種算法應(yīng)用于汽車動(dòng)態(tài)稱重儀表中的結(jié)果做了分析。實(shí)踐證明此算法用于動(dòng)態(tài)稱重具有良好的效果。關(guān)鍵詞： FPGA；FIR；動(dòng)態(tài)稱重引言車輛在動(dòng)態(tài)稱重時(shí)，作用在平臺(tái)上的力除真實(shí)軸重外，還有許多因素產(chǎn)生的干擾力，如：車速、車輛自身諧振、路面激勵(lì)、輪胎驅(qū)動(dòng)力等，給動(dòng)態(tài)稱重實(shí)現(xiàn)高精度測(cè)量造成很大困難。若在消除干擾的過(guò)程中采用模擬方法濾波，參數(shù)則不能過(guò)大，否則將產(chǎn)生過(guò)大的延遲導(dǎo)致不能實(shí)現(xiàn)實(shí)時(shí)處理，從而造成濾波后的信號(hào)仍然含有相當(dāng)一部分的噪聲。所以必須采用數(shù)字濾波消
關(guān)鍵字： FIR FPGA 動(dòng)態(tài)稱重

邊界掃描與電路板測(cè)試技術(shù)

摘要：本文論述了邊界掃描技術(shù)的基本原理和邊界掃描在電路板測(cè)試及在FPGA、DSP器件中的應(yīng)用。介紹了為提高電路板的可測(cè)試性而采用邊界掃描技術(shù)進(jìn)行設(shè)計(jì)時(shí)應(yīng)注意的一些基本要點(diǎn)。關(guān)鍵詞：邊界掃描測(cè)試；JTAG；電路板測(cè)試；可測(cè)試性設(shè)計(jì)引言電子器件的生產(chǎn)商和電子產(chǎn)品的制造商都在傾向于采用最新的器件技術(shù)，如BGA、CSP(芯片規(guī)模封裝)、TCP(倒裝芯片封裝)和其它更小的封裝，以提供更強(qiáng)的功能、更小的體積，并節(jié)省成本。電路板越來(lái)越密、器件越來(lái)越復(fù)雜、電路性能要求越來(lái)越苛刻，越來(lái)越難的接入問(wèn)題導(dǎo)致了工業(yè)標(biāo)準(zhǔn)
關(guān)鍵字： JTAG 邊界掃描測(cè)試電路板測(cè)試可測(cè)試性設(shè)計(jì) PCB 電路板

英特爾成功開(kāi)發(fā)480Mbps之UWB收發(fā)器

日前(4月7日～8日)在甫結(jié)束的日本2004年英特爾IDF論壇中，英特爾首度展示了480Mbps的UWB無(wú)線傳輸，打破該公司在去年實(shí)現(xiàn)的252Mbps紀(jì)錄。據(jù)日經(jīng)BP社消息，英特爾是采用FPGA設(shè)計(jì)LSI收發(fā)器，這代表著可以使用CMOS技術(shù)，以低成本生無(wú)線USB收發(fā)器，無(wú)線傳輸技術(shù)是多頻帶OFDM（版本0.8），所用頻率3GHz～5GHz，使用3個(gè)528MHz的頻帶
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PCB布線設(shè)計(jì)(之四)

AD轉(zhuǎn)換器的精度和分辨率增加時(shí)使用的布線技巧最初，模數(shù)(A/D)轉(zhuǎn)換器起源于模擬范例，其中物理硅的大部分是模擬。隨著新的設(shè)計(jì)拓?fù)鋵W(xué)發(fā)展，此范例演變?yōu)椋诘退貯/D轉(zhuǎn)換器中數(shù)字占主要部分。盡管A/D轉(zhuǎn)換器片內(nèi)由模擬占主導(dǎo)轉(zhuǎn)變?yōu)橛蓴?shù)字占主導(dǎo)，PCB的布線準(zhǔn)則卻沒(méi)有改變。當(dāng)布線設(shè)計(jì)人員設(shè)計(jì)混合信號(hào)電路時(shí)，為實(shí)現(xiàn)有效布線，仍需要關(guān)鍵的布線知識(shí)。本文將以逐次逼近型A/D轉(zhuǎn)換器和∑-△型A/D轉(zhuǎn)換器為例，探討A/D轉(zhuǎn)換器所需的PCB布線策略。圖1. 12位CMOS逐次逼近型A/D轉(zhuǎn)換器的方框圖。此轉(zhuǎn)換器使用了由電容陣
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PCB布線設(shè)計(jì)(之五)

要解決信號(hào)完整性問(wèn)題，最好有多個(gè)工具分析系統(tǒng)性能。如果在信號(hào)路徑中有一個(gè)A/D轉(zhuǎn)換器，那么當(dāng)評(píng)估電路性能時(shí)，很容易發(fā)現(xiàn)三個(gè)基本問(wèn)題：所有這三種方法都評(píng)估轉(zhuǎn)換過(guò)程，以及轉(zhuǎn)換過(guò)程與布線及電路其它部分的交互作用。三個(gè)關(guān)注的方面涉及到頻域分析、時(shí)域分析和直流分析技術(shù)的使用。本文將探討如何使用這些工具來(lái)確定與電路布線有關(guān)問(wèn)題的根源。我們將研究如何決定找什么；到哪里找；如何通過(guò)測(cè)試檢驗(yàn)問(wèn)題；以及如何解決發(fā)現(xiàn)的問(wèn)題等。圖1 SCX015壓力傳感器輸出端的電壓由儀表放大器(A1和A2)放大。在儀表放大器之后，添加了一個(gè)
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PCB布線設(shè)計(jì)(之六)

對(duì)于12位傳感系統(tǒng)的布線，應(yīng)用的電路是一負(fù)載單元電路，該電路可精確測(cè)量傳感器上施加的重量，然后將結(jié)果顯示在LCD顯示屏上。系統(tǒng)電路原理圖如圖1所示。采用的負(fù)載單元是Omega公司的LCL-816G。LCL-816G傳感器模型是由四個(gè)電阻元件組成的橋，需電壓激勵(lì)。將5V激勵(lì)電壓加在傳感器高端，施加900g最大激勵(lì)時(shí)，滿刻度輸出擺幅為±10mV差分信號(hào)。該小差分信號(hào)被雙運(yùn)放儀表放大器放大。根據(jù)電路精度要求，選擇一個(gè)12位A/D轉(zhuǎn)換器。當(dāng)轉(zhuǎn)換器將輸入端的電壓進(jìn)行數(shù)字化后，數(shù)字碼經(jīng)轉(zhuǎn)換器SPI端口發(fā)送到單片機(jī)。然
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PCB布線設(shè)計(jì)(之一)

雙面板布線技巧在當(dāng)今激烈競(jìng)爭(zhēng)的電池供電市場(chǎng)中，由于成本指標(biāo)限制，設(shè)計(jì)人員常常使用雙面板。盡管多層板(4層、6層及8層)方案在尺寸、噪聲和性能方面具有明顯優(yōu)勢(shì)，成本壓力卻促使工程師們重新考慮其布線策略，采用雙面板。在本文中，我們將討論自動(dòng)布線功能的正確使用和錯(cuò)誤使用，有無(wú)地平面時(shí)電流回路的設(shè)計(jì)策略，以及對(duì)雙面板元件布局的建議。自動(dòng)布線的優(yōu)缺點(diǎn)以及模擬電路布線的注意事項(xiàng)設(shè)計(jì)PCB時(shí)，往往很想使用自動(dòng)布線。通常，純數(shù)字的電路板(尤其信號(hào)電平比較低，電路密度比較小時(shí))采用自動(dòng)布線是沒(méi)有問(wèn)題的。但是，在設(shè)計(jì)模擬、混
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PCB布線設(shè)計(jì)(之二)

工程領(lǐng)域中的數(shù)字設(shè)計(jì)人員和數(shù)字電路板設(shè)計(jì)專家在不斷增加，這反映了行業(yè)的發(fā)展趨勢(shì)。盡管對(duì)數(shù)字設(shè)計(jì)的重視帶來(lái)了電子產(chǎn)品的重大發(fā)展，但仍然存在，而且還會(huì)一直存在一部分與模擬或現(xiàn)實(shí)環(huán)境接口的電路設(shè)計(jì)。模擬和數(shù)字領(lǐng)域的布線策略有一些類似之處，但要獲得更好的結(jié)果時(shí)，由于其布線策略不同，簡(jiǎn)單電路布線設(shè)計(jì)就不再是最優(yōu)方案了。本文就旁路電容、電源、地線設(shè)計(jì)、電壓誤差和由PCB布線引起的電磁干擾(EMI)等幾個(gè)方面，討論模擬和數(shù)字布線的基本相似之處及差別。模擬和數(shù)字布線策略的相似之處旁路或去耦電容在布線時(shí)，模擬器件和數(shù)字器件
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PCB布線設(shè)計(jì)(之三)

寄生元件危害最大的情況印刷電路板布線產(chǎn)生的主要寄生元件包括：寄生電阻、寄生電容和寄生電感。例如：PCB的寄生電阻由元件之間的走線形成；電路板上的走線、焊盤和平行走線會(huì)產(chǎn)生寄生電容；寄生電感的產(chǎn)生途徑包括環(huán)路電感、互感和過(guò)孔。當(dāng)將電路原理圖轉(zhuǎn)化為實(shí)際的PCB時(shí)，所有這些寄生元件都可能對(duì)電路的有效性產(chǎn)生干擾。本文將對(duì)最棘手的電路板寄生元件類型 — 寄生電容進(jìn)行量化，并提供一個(gè)可清楚看到寄生電容對(duì)電路性能影響的示例。圖1 在PCB上布兩條靠近的走線，很容易產(chǎn)生寄生電容。由于這種寄生電容的存在，在一條走線上的快
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全數(shù)字鎖相環(huán)的設(shè)計(jì)

摘要：本文在說(shuō)明全數(shù)字鎖相環(huán)的基礎(chǔ)上，提出了一種利用FPGA設(shè)計(jì)一階全數(shù)字鎖相環(huán)的方法，并給出了關(guān)鍵部件的RTL可綜合代碼，并結(jié)合本設(shè)計(jì)的一些仿真波形詳細(xì)描述了數(shù)字鎖相環(huán)的工作過(guò)程，最后對(duì)一些有關(guān)的問(wèn)題進(jìn)行了討論。關(guān)鍵詞：全數(shù)字鎖相環(huán)；DPLL；FSK；FPGA 引言鎖相環(huán)(PLL)技術(shù)在眾多領(lǐng)域得到了廣泛的應(yīng)用。如信號(hào)處理，調(diào)制解調(diào)，時(shí)鐘同步，倍頻，頻率綜合等都應(yīng)用到了鎖相環(huán)技術(shù)。傳統(tǒng)的鎖相環(huán)由模擬電路實(shí)現(xiàn)，而全數(shù)字鎖相環(huán)(DPLL)與傳統(tǒng)的模擬電路實(shí)現(xiàn)的PLL相比，具有精度高且不受溫度和電壓影響，環(huán)路
關(guān)鍵字： DPLL FPGA FSK 全數(shù)字鎖相環(huán)

2003年，Wim Roelandts 成為賽靈思董事會(huì)主席

　　2003年，Wim Roelandts 成為董事會(huì)主席。Bernie Vonderschmitt 離職：公司的最后一個(gè)創(chuàng)始人為我們留下了寶貴的財(cái)富。
關(guān)鍵字：賽靈思 FPGA

2003年，賽靈思推出 Spartan-3 系列產(chǎn)品

　　2003年，推出 Spartan-3 系列產(chǎn)品。世界上首款 90nm FPGA 也是世界上成本最低的 FPGA。Spartan-3 技術(shù)讓我們領(lǐng)先競(jìng)爭(zhēng)者一大步，并使我們處于領(lǐng)先高級(jí)半導(dǎo)體制造商的地位。
關(guān)鍵字：賽靈思 FPGA Spartan-3

Cadence公布工業(yè)界第一個(gè)完整的針對(duì)千兆位速度的PCB系統(tǒng)設(shè)計(jì)環(huán)境

為了幫助設(shè)計(jì)工程師解決千兆速度PCB系統(tǒng)設(shè)計(jì)的挑戰(zhàn)，Cadence Design System公司（NYSE:CDN）今天公布了Cadence15.0版本的印刷電路板（PCB）和集成電路封裝（IC Packaging）設(shè)計(jì)環(huán)境。這一剛剛公布的版本在整個(gè)集成的流程包含了許多革新和增強(qiáng)功能?，F(xiàn)在，工程師終于第一次擁有了設(shè)計(jì)和實(shí)現(xiàn)千兆位串行接口高速PCB系統(tǒng)的集成環(huán)境，可以分析和約束驅(qū)動(dòng)完成跨越芯片，封裝及PCB板三個(gè)系統(tǒng)層面的差分信號(hào)互連。這一強(qiáng)大的功能帶領(lǐng)計(jì)算機(jī)和網(wǎng)絡(luò)公司走上設(shè)計(jì)一次成功之路其它可以提高生產(chǎn)
關(guān)鍵字： Cadence PCB 電路板

2003年，賽靈思宣布將歐洲總部設(shè)在都柏林

　　2003年，賽靈思完成了主要擴(kuò)展，并且宣布將歐洲總部設(shè)在都柏林。
關(guān)鍵字：賽靈思 FPGA

用CPLD和外部SRAM構(gòu)成大容量FIFO的設(shè)計(jì)

摘要：對(duì)照一般通用FIFO的外部控制線，以及視頻服務(wù)器應(yīng)用的具體要求，設(shè)計(jì)完成用CPLD和外部SRAM構(gòu)成的大容量、廉價(jià)、高速FIFO，除了可以滿足視頻服務(wù)器碼流緩沖的需要外，也可以作為一個(gè)通用的大容量FIFO。關(guān)鍵詞：視頻服務(wù)器、碼流平滑、FPGA/CPLD、FIFOThe design of FIFO consisted of CPLD and SRAMRen Sanjun Hu WenjieDSP Center of Institute of Acoustics, Chinese Academy
關(guān)鍵字：視頻服務(wù)器、碼流平滑、FPGA/CPLD、FIFO 存儲(chǔ)器