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基于FPGA的快速傅立葉變換

  • 在對FFT（快速傅立葉變換）算法進(jìn)行研究的基礎(chǔ)上，描述了用FPGA實(shí)現(xiàn)FFT的方法，并對其中的整體結(jié)構(gòu)、蝶形單元及性能等進(jìn)行了分析。
  • 關(guān)鍵字： FPGA  傅立葉變換    

異步FIFO結(jié)構(gòu)及FPGA設(shè)計(jì)

  • 首先介紹異步FIFO的概念、應(yīng)用及其結(jié)構(gòu)，然后分析實(shí)現(xiàn)異步FIFO的難點(diǎn)問題及其解決辦法；在傳統(tǒng)設(shè)計(jì)的基礎(chǔ)上提出一種新穎的電路結(jié)構(gòu)并對其進(jìn)行綜合仿真和FPGA實(shí)現(xiàn)。
  • 關(guān)鍵字： FIFO  FPGA    

3-DES算法的FPGA高速實(shí)現(xiàn)

  • 介紹3-DES算法的概要；以Xilinx公司SPARTANII結(jié)構(gòu)的XC2S100為例，闡述用FPGA高速實(shí)現(xiàn)3-DES算法的設(shè)計(jì)要點(diǎn)及關(guān)鍵部分的設(shè)計(jì)。
  • 關(guān)鍵字： FPGA  DES  算法  高速實(shí)現(xiàn)    

基于CPLD/FPGA的半整數(shù)分頻器的設(shè)計(jì)

  • 簡要介紹了CPLD/FPGA器件的特點(diǎn)和應(yīng)用范圍，并以分頻比為2.5的半整數(shù)分頻器的設(shè)計(jì)為例，介紹了在MAX+plus II開發(fā)軟件下，利用VHDL硬件描述語言以及原理圖的輸入方式來設(shè)計(jì)數(shù)字邏輯電路的過程和方法。
  • 關(guān)鍵字： CPLD  FPGA  整數(shù)  分頻器    

基于FPGA的總線型LVDS通信系統(tǒng)設(shè)計(jì)

  • 本文介紹一種基于總線型LVDS的通信系統(tǒng)方案，以及利用FPGA芯片實(shí)現(xiàn)系統(tǒng)核心模塊的設(shè)計(jì)方法。
  • 關(guān)鍵字： FPGA  LVDS  總線  通信    

基于FPGA的多路模擬量、數(shù)字量采集與處理系統(tǒng)

  • 提出一種基于FPGA技術(shù)的多路模擬量、數(shù)字量采集與處理系統(tǒng)的設(shè)計(jì)方案，分析整個(gè)系統(tǒng)的結(jié)構(gòu)，并討論FPGA內(nèi)部硬件資源的劃分和軟件的設(shè)計(jì)方案等。
  • 關(guān)鍵字： FPGA  多路  模擬量  數(shù)字量采集    

固定幾何結(jié)構(gòu)的FFT算法及其FPGA實(shí)現(xiàn)

  • 固定幾何結(jié)構(gòu)的FFT算法及其FPGA實(shí)現(xiàn)。
  • 關(guān)鍵字： FPGA  FFT  幾何  算法    

基于FPGA的高速高精度頻率測量的研究

  • 本文介紹的測頻方法，不僅消除了直接測頻方法中對測量頻率需要采用分段測試的局際，而且在整個(gè)測試頻段內(nèi)能夠保持高精度不變。
  • 關(guān)鍵字： FPGA  高精度  頻率  量的研究    

PSD813F2在FPGA配置中的應(yīng)用

  • 可編程外圍器件PSD應(yīng)用于單片機(jī)系統(tǒng)后，簡化了單片機(jī)外圍電路的設(shè)計(jì)，增加了系統(tǒng)的可靠性；利用PSD與單片機(jī)組成的系統(tǒng)，通過計(jì)算機(jī)串口對FPGA進(jìn)行實(shí)時(shí)在線編程、仿真和配置。
  • 關(guān)鍵字： 813F  FPGA  PSD  813    

用PowerPC860實(shí)現(xiàn)FPGA配置

  • 介紹如何用PowerPC860（MPC860）進(jìn)行FPGA（Xilinx的Virtex-II系列）的配置；給出進(jìn)行FPGA配置所需的詳細(xì)時(shí)序圖和原理圖。
  • 關(guān)鍵字： PowerPC  FPGA  860    

用SoC實(shí)現(xiàn)視頻圖形引擎功能的研究

  • 結(jié)合實(shí)際方案對目前國內(nèi)研究熱點(diǎn)的SoC設(shè)計(jì)進(jìn)行一些討論，主要對系統(tǒng)集成、算法與系統(tǒng)芯片結(jié)構(gòu)、可測試性設(shè)計(jì)等方面進(jìn)行一些相關(guān)探討。
  • 關(guān)鍵字： SoC  視頻圖形  引擎    

利用FPGA實(shí)現(xiàn)MMC2107與SDRAM接口設(shè)計(jì)

  • 介紹基于現(xiàn)場可編程門陣列（FPGA），利用VHDL語言設(shè)計(jì)實(shí)現(xiàn)MMC2107與SDRAM接口電路。文中包括MMC2107組成結(jié)構(gòu)、SDRAM存儲接口結(jié)構(gòu)和SDRAM控制狀態(tài)機(jī)的設(shè)計(jì)。
  • 關(guān)鍵字： SDRAM  FPGA  MMC    

射頻SoC nRF9E5及無線數(shù)據(jù)傳輸系統(tǒng)的實(shí)現(xiàn)

51兼容射頻Soc nRF9E5與無線光機(jī)鼠標(biāo)設(shè)計(jì)

動態(tài)時(shí)鐘配置下的SoC低功耗管理

  • 隨著芯片集成度的提高，對一些功能復(fù)雜的系統(tǒng)芯片功耗的管理，已經(jīng)引起大家越來越多的重視，如何控制好SoC的功耗將成為芯片能否成功的重要因素。
  • 關(guān)鍵字： 功耗  管理  SoC  配置  時(shí)鐘  動態(tài)  
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