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萊迪思FPGA助力聯(lián)想新一代網(wǎng)絡(luò)邊緣AI體驗
- 萊迪思半導體宣布其CrossLink-NX FPGA和專為AI優(yōu)化的軟件解決方案，將用于聯(lián)想最新的ThinkPad X1系列筆記本電腦中。全新的聯(lián)想ThinkPad產(chǎn)品系列采用萊迪思充分整合的客戶端硬件和軟件解決方案，能夠在不損失效能或電池使用時間的情況下提供優(yōu)化的使用者體驗，包括沉浸式互動、更好的隱私保護和更高效的協(xié)作。 萊迪思FPGA助力聯(lián)想新一代網(wǎng)絡(luò)邊緣AI體驗萊迪思營銷和業(yè)務(wù)發(fā)展副總裁Matt Dobrodziej表示：「我們的AI優(yōu)化解決方案產(chǎn)品旨在滿足希望實現(xiàn)更高智能的各種網(wǎng)絡(luò)邊緣應
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聯(lián)發(fā)科下一代旗艦Soc曝光：臺積電4nm工藝
- 昨晚，博主 數(shù)碼閑聊站爆料，明年是聯(lián)發(fā)科沖擊高端市場的關(guān)鍵一年，聯(lián)發(fā)科下一代旗艦芯片將是前期唯一一款基于臺積電4nm工藝打造的產(chǎn)品?！ 〈饲芭兜男畔@示，聯(lián)發(fā)科下一代旗艦Soc可能會命名為天璣2000?！ ?jù)爆料，天璣2000將采用超大核+大核+小核的三叢核架構(gòu)，其中超大核為Cortex X2，與目前的Cortex-X1相比，Cortex-X2在指令集升級為ARMv9-A的同時，還針對分支預測與預取單元、流水線長度、亂序執(zhí)行窗口、FP/ASIMD流水線、載入存儲窗口和結(jié)構(gòu)等進行了專門優(yōu)化，提升處理效
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芯翼信息科技完成近5億元B輪融資
- 近日，物聯(lián)網(wǎng)智能終端系統(tǒng)SoC芯片提供商芯翼信息科技（上海）有限公司（以下簡稱：芯翼信息科技或公司）完成近5億元B輪融資，資金主要用于加強芯片產(chǎn)品研發(fā)、完善生產(chǎn)制造供應鏈、擴充核心團隊等。本輪投資由招銀國際、中金甲子聯(lián)合領(lǐng)投，招商局資本、寧水集團、亞昌投資等跟投，另外老股東峰瑞資本、晨道資本、華睿資本等持續(xù)加注。芯翼信息科技成立于2017年，是一家專注于物聯(lián)網(wǎng)智能終端系統(tǒng)SoC芯片研發(fā)的高新技術(shù)企業(yè)，產(chǎn)品涵蓋通訊、主控計算、傳感器、電源管理、安全等專業(yè)領(lǐng)域。公司創(chuàng)始人及核心研發(fā)團隊來自于美國博通、邁凌、瑞
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Silicon Labs在全球率先推出安全Sub-GHz片上系統(tǒng)，無線傳輸距離超過1英里，電池壽命超過10年
- – Silicon Labs擴展Series 2平臺，支持Amazon Sidewalk、mioty、無線M-Bus和Z-Wave
- 關(guān)鍵字： Silicon Labs 物聯(lián)網(wǎng) SoC
AI與機器學習發(fā)展迅速，F(xiàn)PGA可提供高能效和靈活性
- 1? ?為什么AI/ML發(fā)展如此迅速？多年來，人工智能（AI）/機器學習（ML）市場一直以指數(shù)級的速度快速增長，其解決方案遍布我們周圍，從機器人和其他機械系統(tǒng)的預測故障算法、電子商務(wù)中的購買行為建議、自動駕駛車輛的目標檢測、電子交易中的風險緩解到DNA測序等等，我們身邊有各種各樣的解決方案，示例不勝枚舉。那么，為什么AI/ML發(fā)展如此迅速呢？據(jù)IDC、Gartner和其他市調(diào)機構(gòu)的分析，全球大約80%的數(shù)據(jù)是非結(jié)構(gòu)化數(shù)據(jù)。電子郵件、照片、語音郵件、視頻和許多其他數(shù)據(jù)源每天都在堆積。無論
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一種基于FPGA的BiSS編碼器解碼器設(shè)計
- BiSS協(xié)議是一種高速同步串行通信協(xié)議，使用BiSS協(xié)議的編碼器有利于提高伺服控制系統(tǒng)的動態(tài)性能，在高精度絕對式編碼器中應用廣泛。本文在分析BiSS協(xié)議數(shù)據(jù)幀特點的基礎(chǔ)上，利用FPGA設(shè)計了BiSS協(xié)議編碼器解碼器，采集了BiSS協(xié)議編碼器位置數(shù)據(jù)和總線波形，通過與DSP聯(lián)合使用，基于BiSS協(xié)議編碼器對永磁同步電機的動態(tài)性能進行了驗證，結(jié)果表明該設(shè)計的合理性。
- 關(guān)鍵字： BiSS FPGA 編碼器 DSP 202108
基于FPGA的一種DDR4存儲模塊設(shè)計
- 5G通信的主要特征包括“高速率、大帶寬”，為了滿足高速率、大帶寬數(shù)據(jù)的傳輸要求，需要一種存儲技術(shù)對數(shù)據(jù)進行存儲。本文就存儲技術(shù)結(jié)合DDR4協(xié)議，設(shè)計了一種DDR4傳輸機制，本研究采用高性能的XCVU9P系列的FPGA芯片作為控制芯片，使用其內(nèi)部自帶的DDR4 SDRAM（MIG）IP核進行例化核設(shè)計。經(jīng)過驗證，實現(xiàn)在250 MHz時鐘下對DDR4 SDRAM的讀/寫操作，數(shù)據(jù)無丟失，能夠保證高速率、大帶寬數(shù)據(jù)正常傳輸，該傳輸機制具有良好的可靠性、適用性及有效性。
- 關(guān)鍵字： DDR4 高速率 大帶寬 FPGA 202108
英特爾推進全新架構(gòu)，面向數(shù)據(jù)中心、HPC-AI和客戶端計算
- 英特爾推出兩大x86 CPU內(nèi)核、兩大數(shù)據(jù)中心SoC、兩款獨立GPU，以及變革性的客戶端多核性能混合架構(gòu) 本文作者：Raja M.Koduri英特爾公司高級副總裁兼加速計算系統(tǒng)和圖形事業(yè)部總經(jīng)理 架構(gòu)是硬件和軟件的“煉金術(shù)”。它融合特定計算引擎所需的先進晶體管，通過領(lǐng)先的封裝技術(shù)將它們連接，集成高帶寬和低功耗緩存，在封裝中為混合計算集群配備高容量、高帶寬內(nèi)存和低時延、可擴展互連，并確保所有軟件無縫地加速。披露面向新產(chǎn)品的架構(gòu)創(chuàng)新，是英特爾架構(gòu)師在每年架構(gòu)日上的期許，今年舉辦的第三屆英特爾架構(gòu)日令人
- 關(guān)鍵字： 英特爾 架構(gòu)日 CPU SoC GPU IPU
基于逐次最鄰近插值的動力電池電壓模擬方法*
- 動力電池模擬系統(tǒng)是新能源汽車測試平臺等工業(yè)領(lǐng)域的重要裝備，而電池模型是該系統(tǒng)能否精確模擬電池特性的關(guān)鍵環(huán)節(jié)。為兼顧數(shù)據(jù)容量和給定電壓的精確性，提出逐次最鄰近插值算法應用于電池模型數(shù)據(jù)查表，該方法根據(jù)動力電池在電池電荷狀態(tài)(State of Charge，SOC)初始段、平穩(wěn)段和末尾段的輸出特性，建立了三個不同分辨率的模型子表，并借鑒最鄰近插值算法的計算量小和容易實現(xiàn)的優(yōu)點，采用對模型表逐次迭代分區(qū)，進而逼近實際SOC和采樣電流對應的電池模型給定電壓值，達到細化電池模型表分辨率效果。討論了迭代次數(shù)選擇對算法
- 關(guān)鍵字： 查表 最鄰近插值算法 動力電池 SOC 給定電壓 202102
毫米波5G接收機多速率數(shù)據(jù)設(shè)計與研究
- 針對5G毫米波通信宏基站、微基站等設(shè)備的研發(fā)、生產(chǎn)、預認證、維修保障等測試需求，設(shè)計一款可應用于“5G新基建”通信設(shè)備產(chǎn)業(yè)鏈多環(huán)節(jié)所需儀表的高效多速率信號接收機處理模塊。采用先進的并行多相濾波技術(shù)和任意速率比FFT處理技術(shù)，基于FPGA算法平臺實現(xiàn)毫米波5G接收機多路信號接收時域/頻域并行變速率處理邏輯電路，提高5G復雜波形接收機信號解析的實時性。實驗結(jié)果表明，該電路能高效完成5G復雜波形接收機信號的時域/頻域解析，適合作為毫米波5G接收機多速率數(shù)據(jù)處理實施方案，滿足毫米波5G接收機的功能設(shè)計要求。
- 關(guān)鍵字： FPGA 5G 毫米波 接收機 202105
基于EG4A20BG256和AD7403的電流采樣電路設(shè)計
- AD7403是一種Σ-Δ型模數(shù)轉(zhuǎn)換器，廣泛應用于需要電氣隔離的伺服控制電機相電流采集場合。EG4A20BG256是一種國產(chǎn)FPGA，適用于伺服控制系統(tǒng)信號采集﹑接口擴展等應用場景。本文基于EG4A20BG256 FPGA設(shè)計了AD7403模數(shù)轉(zhuǎn)換器接口電路，采集永磁同步電機相電流，并與伺服控制電路內(nèi)霍爾電流傳感器和DSP采樣結(jié)果進行了對比。結(jié)果表明，EG4A20BG256 FPGA可以通過AD7403模數(shù)轉(zhuǎn)換器實現(xiàn)對永磁同步電機相電流的準確采集。
- 關(guān)鍵字： AD7403 EG4A20BG256 FPGA DSP 永磁同步電機 202105
一種BiSS協(xié)議的編碼器數(shù)據(jù)讀取方法
- 摘要：針對目前BiSS協(xié)議編碼器數(shù)據(jù)讀取多采用FPGA實現(xiàn)的實際情況，文中介紹一種基于XMC4500微控制器的BiSS協(xié)議編碼器數(shù)據(jù)讀取實現(xiàn)方案。采用該方案，可將使用BiSS協(xié)議編碼器的伺服系統(tǒng)控制電路常用的DSP+FPGA雙控制器架構(gòu)方式簡化為XMC4500單控制器方式，在一定程度上降低了硬件成本和開發(fā)難度。用該方案采集BiSS協(xié)議編碼器數(shù)據(jù)的實物平臺，使用LabVIEW顯示對讀取的數(shù)據(jù)，并與電機自帶增量編碼器值進行對比，同時記錄BiSS協(xié)議編碼器實際數(shù)據(jù)波形圖，結(jié)果表明，該方案具有較高的采樣速率和較好
- 關(guān)鍵字： 202106 BiSS XMC4500 DSP FPGA LabVIEW
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