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SoC系統(tǒng)描述與SystemC

  • 摘    要：隨著VLSI工藝技術(shù)的發(fā)展，為了縮短開發(fā)周期，提高設計的可預見性，SoC設計已經(jīng)成為迫切需求。本文將比較C++、VHDL和SystemC，說明SystemC是一種非常好的系統(tǒng)描述語言。同時利用C++和VHDL的語法來深入介紹SystemC的語法。 引言在早期的集成電路設計過程中，由于低抽象層次的設計問題比高抽象層次的設計問題手工處理更難，這迫使研究者首先把注意力集中到低層次設計問題上。例如：電路仿真、布局、布線和布局規(guī)劃。隨著低層次設計問題變得易于處理，邏輯仿
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以系統(tǒng)為中心的全層次納米級SoC設計方法學

  • 引言2003年SoC的收入達到了310億美元，隨著通信行業(yè)及個人電子設備市場的快速發(fā)展，這一數(shù)字有望在2008年再翻上一番。其主要應用領域包括：數(shù)字蜂窩式移動電話及基礎設施、存儲設備、視頻游戲機、消費類顯示設備、圖形卡、數(shù)字電視、個人電腦用主板、寬帶接入設備以及DVD等。個人電子設備需求的持續(xù)上升表示SoC設計正發(fā)展到一個轉(zhuǎn)折點，因為此類系統(tǒng)的產(chǎn)品壽命一般都不會超過一年，而新產(chǎn)品的問世周期為兩年。研究表明，一項高科技新產(chǎn)品只要延遲上市6個月，其生命周期內(nèi)的收入就要減少大概30%。而且，近年來這種商業(yè)影響有
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測試復雜的多總線SoC器件

  • 使用多個復雜的總線已經(jīng)成為系統(tǒng)級芯片(SoC)器件的標準，這種總線結(jié)構(gòu)的使用使測試工程師面臨處理多個時鐘域問題的挑戰(zhàn)。早期器件的測試中，工程師可以依賴某些自動化測試設備(ATE)的雙時域能力測試相對簡單的總線結(jié)構(gòu)。目前測試工程師面臨更復雜的SoC器件，這些器件反應了越來越多使用多個高速總線結(jié)構(gòu)的趨勢。使用有效的技術(shù)和下一代測試系統(tǒng)，如Credence(科利登)的Octet，測試工程師能夠成功地管理與復雜SoC器件(如北橋器件)中多總線結(jié)構(gòu)相關(guān)的獨立時鐘域。通過掌握ATE的能力，測試開發(fā)過程中，測試工程師能
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低功耗SoC存儲器設計選擇

  • 當今的設計師面對無數(shù)的挑戰(zhàn)：一方面他們必須滿足高技術(shù)產(chǎn)品不斷擴展的特性需求，另一方面卻不得不受到無線和電池裝置的電源限制。沒有任何技術(shù)在這方面的要求比SoC的設計更為明顯，在這種設計中，高級工藝比從前復雜的多。然而，上述技術(shù)造成了新的電源問題。現(xiàn)代SoC系統(tǒng)的關(guān)鍵之一就是：嵌入存儲器在芯片中的比例在不斷增長。當存儲器開始主導SoC時，應用節(jié)能技術(shù)使存儲器獲得系統(tǒng)電源變得十分重要。重要問題之一就是：在系統(tǒng)結(jié)構(gòu)方面，是嵌入系統(tǒng)存儲器還是把存儲器放在SoC之外。在以前的技術(shù)中，電源不是要考慮的一個主要因素，而成
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基于ARM內(nèi)核的手持設備SoC

  •  摘    要：本文研究并開發(fā)了一款針對手持設備、內(nèi)嵌ARM7TDMI內(nèi)核的系統(tǒng)芯片。在設計這款芯片的過程中，MP3算法的軟硬件分割和芯片的低功耗設計是主要挑戰(zhàn)。本文介紹了該系統(tǒng)芯片的結(jié)構(gòu)，并著重介紹了軟硬件分割和低功耗設計技術(shù)。關(guān)鍵詞：系統(tǒng)芯片；低功耗；ARM；MP3 引言隨著半導體技術(shù)的進步和芯片設計方法—IP重用技術(shù)的出現(xiàn)，SoC在消費類電子產(chǎn)品中已經(jīng)越來越普遍。本課題組去年啟動了稱為Garfield的SoC項目。Garfield定義為一款面向中低端PDA的
  • 關(guān)鍵字： ARM  MP3  低功耗  系統(tǒng)芯片  SoC  ASIC  

利用SoC單片機的多功能數(shù)據(jù)采集卡

  • 摘    要：本文介紹了一種SoC單片機控制的多功能數(shù)據(jù)采集卡，在輸入通道中增加程控濾波、程控增益放大器和多級陷波電路，采集卡的功能選擇和參數(shù)改變均由SoC單片機軟件控制。本文給出了關(guān)鍵部分的電路圖、元件參數(shù)和實測數(shù)據(jù)。關(guān)鍵詞：SoC 單片機；程控放大；程控陷波 引言目前大多數(shù)的數(shù)據(jù)采集卡并不能適應工業(yè)控制現(xiàn)場或像野外那樣存在多種噪聲干擾的使用環(huán)境，特別是對50Hz工頻干擾及其諧波干擾無法起到抑制作用。在這種情況下，采集到的數(shù)據(jù)往往有很多錯誤或者采集卡無法正常工作。本數(shù)據(jù)采
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基于C*SoC200的32位稅控機專用系統(tǒng)芯片設計

  • 摘    要：本文首先介紹了一個32位嵌入式稅控機專用系統(tǒng)芯片C3118的功能、結(jié)構(gòu)和特點，然后分析了一個自動化程度很高的SoC設計平臺——C*SoC200，對該平臺的主要結(jié)構(gòu)和功能進行了分析。關(guān)鍵詞：IP；SoC；平臺；仿真 引言2003年7月，中國國家質(zhì)量監(jiān)督檢驗檢疫總局發(fā)布了由稅控機國家標準制定委員會制定的稅控收款機國家標準。并將陸續(xù)出臺一系列的管理法規(guī)。為了滿足國家標準的要求，各稅控機生產(chǎn)廠家都在積極使用32位MCU開發(fā)符合新規(guī)范的稅控機。而32位的嵌入式稅控機專用
  • 關(guān)鍵字： IP  SoC  仿真  平臺  SoC  ASIC  

合理選擇SoC架構(gòu)

  • 找到價格、性能和功耗的最佳結(jié)合點實際上就確保贏得了SoC設計，但說起來容易做起來難。在實際可用的雙芯核架構(gòu)、可編程加速器和數(shù)百萬門FPGA出現(xiàn)以前，一種80:20法則用起來很奏效：如果計算負荷的80%為數(shù)據(jù)處理，那么選擇RISC架構(gòu)，在RISC中實施信號處理。而當今面臨太多的架構(gòu)選擇，差別甚微，用單一處理器架構(gòu)來解決優(yōu)化問題已不可能。一種較為成功的方法是通過將計算資源與特性集匹配來實現(xiàn)。將一種復雜系統(tǒng)映射到硅中，在相當程度上依賴于設計是在現(xiàn)有SoC上實現(xiàn)還是從頭做起。對于前一種情況，系統(tǒng)設計師應從了解四個
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可配置系統(tǒng)級驗證環(huán)境加速SoC開發(fā)

  • 利用嵌入式硅IP可以縮短SoC設計所需的開發(fā)時間，這已成為眾所公認的事實。但要從完工后的整個系統(tǒng)角度出發(fā)，整合及驗證來自多家廠商的元件，需要相當?shù)臅r間和努力，然而它們卻常被忽略。這會對嵌入式軟件開發(fā)人員造成額外負擔，因為他們需要SoC的外圍和接口以及處理器的精確模型，才能在設計投片之前，針對正在開發(fā)的SoC，迅速完成應用固件的測試及除錯。如果SoC平臺以可配置處理器和外圍IP為基礎，這些IP又來自多家供貨商，這種情形就更加重要，因為設計人員必須確認在特定配置下，每個元件的功能不會影響到其它元件的工作。除此
  • 關(guān)鍵字： ARC  SoC  ASIC  

雙層AMBA總線設計及其在SoC芯片設計中的應用

  • 摘    要：AMBA總線是目前主流的片上總線。本文給出的雙層AMBA總線設計能極大地提高總線帶寬，并使系統(tǒng)架構(gòu)更為靈活。文章詳細介紹了此設計的實現(xiàn)，并從兩個方面對兩種總線方式進行了比較。關(guān)鍵詞：雙層AMBA總線;總線帶寬;SoC 引言一般說來，SoC芯片是由片上芯核、用戶設計的IP核以及將這兩者集成在一起的總線組成的。片上芯核決定了使用何種片上總線以及芯片的體系結(jié)構(gòu)。ARM系列嵌入式微處理器憑借其高性能、低功耗的特點占據(jù)了市場的主要份額，ARM7TDMI因其相對低廉的價格
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可復用SPI模塊IP核的設計與驗證

  • SoC是超大規(guī)模集成電路的發(fā)展趨勢和新世紀集成電路的主流。其復雜性以及快速完成設計、降低成本等要求，決定了系統(tǒng)級芯片的設計必須采用IP（Intellectual Property）復用的方法。
  • 關(guān)鍵字： SPI  可復用  IP核  模塊    

基于SOPC技術(shù)的事故現(xiàn)場處理平臺設計與實現(xiàn)

  • 摘    要：本文介紹了利用SOPC設計方法，以Altera公司的Nios軟核處理器為核心完成的事故現(xiàn)場處理平臺的設計。就其中最重要的兩部分——SCCB總線控制模塊和SRAM讀寫控制模塊的具體實現(xiàn)做了詳細介紹，并給出了SRAM寫控制器的實際仿真結(jié)果。最后，總結(jié)了SOPC的設計方法。關(guān)鍵詞：SOPC；事故現(xiàn)場處理平臺；IP核；SCCB總線引言當前移動警務的廣泛應用，使得交警在事故現(xiàn)場就能夠?qū)φ厥滤緳C和車輛進行現(xiàn)場處理。但是，大部分的應用只是停留在車牌號碼等非常簡單的文本數(shù)據(jù)的傳
  • 關(guān)鍵字： IP核  SCCB總線  SOPC  事故現(xiàn)場處理平臺  

混合信號電路設計技術(shù)研究

  • 摘    要：本文針對航天電子系統(tǒng)小型化發(fā)展的特殊要求，提出在星載電子系統(tǒng)中進行混合信號電路設計，重點探討了混合信號電路設計技術(shù)所面臨的問題及其對策，并以星載計算機的下行信道設計為例，對航天微電子系統(tǒng)的混合信號設計進行了初步探索。關(guān)鍵詞： 系統(tǒng)級芯片；混合信號；設計流程；IP核引言航天市場的需求帶動了衛(wèi)星技術(shù)的發(fā)展，微型、納型甚至皮型衛(wèi)星的研究已成為航天技術(shù)研究的熱點。微電子技術(shù)、系統(tǒng)集成技術(shù)、微機電技術(shù)、微組裝技術(shù)以及輕型結(jié)構(gòu)材料技術(shù)的發(fā)展使得衛(wèi)星進一步小型化成為可能。從星
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Cypress推出小體積高集成度PSoCTM器件

  • 賽普拉斯半導體公司的子公司——賽普拉斯微系統(tǒng)公司 (Cypress MicroSystems) 近日宣布：其體積最小、集成度最高的可編程系統(tǒng)級芯片 (PSoCTM) 混合信號陣列已進入批量生產(chǎn)銷售階段。除了4個可配置模擬部件和4個可配置數(shù)字部件之外，CY8C21x34器件還提供了用于程序存儲器的8K字節(jié)快閃存儲器和用于數(shù)據(jù)存儲的512字節(jié)SRAM，從而使其成為對成本敏感的消費類和工業(yè)控制應用（比如觸摸感應控制屏、安全傳感器和控制、智能型溫度、壓力和流量傳感器、大型傳感器陣列、風扇控制器和電池充電器等）的理
  • 關(guān)鍵字： Cypress  SoC  ASIC  

開放核協(xié)議—IP核在SoC設計中的接口技術(shù)

  • 摘    要：本文介紹了IP核的概念及其在SoC設計中的應用，討論了為提高IP核的復用能力而采用的IP核與系統(tǒng)的接口技術(shù)。 關(guān)鍵詞：SoC；IP核；OCP引言隨著半導體技術(shù)的發(fā)展,深亞微米工藝加工技術(shù)允許開發(fā)上百萬門級的單芯片，已能夠?qū)⑾到y(tǒng)級設計集成到單個芯片中即實現(xiàn)片上系統(tǒng)SoC。IP核的復用是SoC設計的關(guān)鍵，但困難在于缺乏IP核與系統(tǒng)的接口標準，因此，開發(fā)統(tǒng)一的IP核接口標準對提高IP核的復用意義重大。本文簡單介紹IP核概念，然后從接口標準的角度討論在SoC設計中提高I
  • 關(guān)鍵字： IP核  OCP  SoC  SoC  ASIC  
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