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EEPW首頁(yè) >> 主題列表 >> asic ip核

FPGA和ASIC的比較

  • ASIC是英文的Application Specific Integrated Circuits縮寫(xiě)，即專用集成電路，是指應(yīng)特定用戶要求和特定電子系統(tǒng)的需要而設(shè)計(jì)、制造的集成電路。目前用CPLD(復(fù)雜可編程邏輯器件)和FPGA(現(xiàn)場(chǎng)可編程邏輯陣列)來(lái)進(jìn)行AS
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SoC中的處理單元性能評(píng)估及功能劃分

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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基于Avalon總線接口的UPFC控制器IP核設(shè)計(jì)

  • 0引言統(tǒng)一潮流控制器(UnifiedPowerFlowCon-troller，簡(jiǎn)稱UPFC)是一種可以較大范圍地控制電流使之按指定路...
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泰克元件解決方案公司與MOSIS簽訂ASIC服務(wù)協(xié)議

  • 定制微電子服務(wù)提供商---泰克元件解決方案公司(Tektronix Component Solutions)日前宣布，與領(lǐng)先的供應(yīng)鏈集成商(aggregator)-- MOSIS公司就幫助客戶開(kāi)發(fā)完整的高性能ASIC解決方案，同時(shí)降低早期ASIC開(kāi)發(fā)成本達(dá)成協(xié)議。
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FPGA和ASIC的電源管理方案

  • 目前的電子產(chǎn)品市場(chǎng)競(jìng)爭(zhēng)非常激烈，廠商都希望能在最短時(shí)間內(nèi)將新產(chǎn)品推出市場(chǎng)，以致子系統(tǒng)的設(shè)計(jì)周期越縮越...
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基于BIST的IP核測(cè)試方案設(shè)計(jì)

  • 1 引言　　隨著半導(dǎo)體工藝的發(fā)展，片上系統(tǒng)SOC已成為當(dāng)今一種主流技術(shù)。基于IP復(fù)用的SOC設(shè)計(jì)是通過(guò)用戶自定義邏輯(UDL)和連線將IP核整合為一個(gè)系統(tǒng)，提高了設(shè)計(jì)效率，加快了設(shè)計(jì)過(guò)程，縮短了產(chǎn)品上市時(shí)間。但是隨著設(shè)
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ASIC和微處理器芯片供電電源電路介紹

  • 今天的高性能ASIC和微處理器芯片消耗的功率可超過(guò)150瓦。對(duì)于1 V1.5 V的供電電壓，這些器件所需要的電流可輕易超過(guò)100 A。通過(guò)采用多相直流/直流轉(zhuǎn)換器，為此類器件供電的任務(wù)可變得更容易處理。 目前，可擴(kuò)展控制器
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富士通半導(dǎo)體交付55nm創(chuàng)新方案

  • 　　解本土IC設(shè)計(jì)之“渴” 　　近來(lái)中國(guó)IC市場(chǎng)的最重磅新聞要屬大小“M”——臺(tái)灣聯(lián)發(fā)科(MTK)和晨星半導(dǎo)體(MStar)宣布合并?！癕兄弟”的聯(lián)手對(duì)已跨入“1億美元俱樂(lè)部”的少數(shù)剛崛起的大陸本土IC設(shè)計(jì)公司帶來(lái)很大的競(jìng)爭(zhēng)壓力，而原本就缺資金、缺平臺(tái)、缺資源的本土小型和微型IC廠商的生存空間更加令人堪憂。 　　正如富士通半導(dǎo)體ASIC/COT業(yè)務(wù)市場(chǎng)部副經(jīng)理劉哲女士在不久前閉幕的&
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ASIC和微處理器芯片供電電源介紹及應(yīng)用實(shí)例

  • 今天的高性能ASIC和微處理器芯片消耗的功率可超過(guò)150瓦。對(duì)于1 V1.5 V的供電電壓，這些器件所需要的電流可輕易超過(guò)100 A。通過(guò)采用多相直流/直流轉(zhuǎn)換器，為此類器件供電的任務(wù)可變得更容易處理。 目前，可擴(kuò)展控制器
  • 關(guān)鍵字： 介紹  應(yīng)用  實(shí)例  電源  供電  微處理器  芯片  ASIC  

ISOFACE提供智能化保護(hù)

  • 摘要：ISOFACE產(chǎn)品家族能以智能化方式解決大多數(shù)工業(yè)自動(dòng)化系統(tǒng)所面臨的共同挑戰(zhàn)，譬如，可編程邏輯控制器(PLC)、驅(qū)動(dòng)器、工業(yè)PC、機(jī)器人系統(tǒng)、分布式控制系統(tǒng)、樓宇控制系統(tǒng)、普通控制設(shè)備和傳感器輸入模組。
  • 關(guān)鍵字： 工業(yè)自動(dòng)化  ISOFACE  ASIC  201206  

基于FPGA的DDS IP核設(shè)計(jì)

  • 摘要：以Altera公司的QuartusⅡ7．2作為開(kāi)發(fā)工具，研究了基于FPGA的DDS IP核設(shè)計(jì)，并給出基于Signal TapⅡ嵌入式邏輯分析儀的仿真測(cè)試結(jié)果。將設(shè)計(jì)的DDS IP核封裝成為SOPC Builder自定義的組件，結(jié)合32位嵌入式CPU軟
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使用LabVIEW FPGA模塊設(shè)計(jì)IP核

  • 對(duì)于利用LabVIEW FPGA實(shí)現(xiàn)RIO目標(biāo)平臺(tái)上的定制硬件的工程師與開(kāi)發(fā)人員，他們可以很容易地利用所推薦的組件設(shè)計(jì)構(gòu)建適合其應(yīng)用的、可復(fù)用且可擴(kuò)展的代碼模塊?；谝呀?jīng)驗(yàn)證的設(shè)計(jì)進(jìn)行代碼模塊開(kāi)發(fā)，將使現(xiàn)有IP在未來(lái)應(yīng)
  • 關(guān)鍵字： LabVIEW  FPGA  IP核  模塊設(shè)計(jì)    

Nufront第三代處理器采用Cadence接口IP解決方案

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司 (NASDAQ: CDNS)，日前宣布Nufront(新岸線)的NS115芯片組采用了Cadence可配置的DDR3/3L/LPDDR2存儲(chǔ)控制器與硬化PHY IP核，應(yīng)用于其雙核ARM Cortex –A9移動(dòng)應(yīng)用處理器。TSMC 40LP工藝， 32位DDR3/LPDDR2接口的數(shù)據(jù)傳輸速率最高可達(dá)800Mbps，并能提供對(duì)超薄筆記本、平板電腦和智能手機(jī)等產(chǎn)品至關(guān)重要的基于數(shù)據(jù)流量的自動(dòng)功耗管理。 Cadence 的DDR3/3L/LPDDR2 IP
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Leon2處理器IP核技術(shù)

  • Leon2是GaislerResearch公司于2003年研制完成的一款32位、符合IEEE-1754(SPARCVS)結(jié)構(gòu)的處理器IP核。它的前 ...
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Cosmic Circuits力爭(zhēng)成為主要的半導(dǎo)體IP核提供商

  • 　　Cosmic Circuits，領(lǐng)先的差異化模擬和混合信號(hào)IP核提供商，宣布開(kāi)發(fā)MIPI D-PHY、MIPI M-PHY、USB2.0、USB3.0、PCI Express和HDMI IPs標(biāo)準(zhǔn)的28納米和20納米IP核。Cosmic Circuits也正在開(kāi)發(fā)這些標(biāo)準(zhǔn)的控制器解決方案，以便為客戶提供完整的解決方案。 　　Cosmic Circuits提供差異化混合信號(hào)IP核的廣泛組合，提供的產(chǎn)品大致分為兩類：AMS(模擬和混合信號(hào))IP核和連接(接口)IP核。Cosmic Circuits的AM
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asic ip核介紹

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