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TMS320C672x系列浮點(diǎn)DSP的EMIF研究與應(yīng)用
- TMS320C672x系列浮點(diǎn)DSP的EMIF研究與應(yīng)用,針對如何靈活應(yīng)用高性能32／64位浮點(diǎn)DSP TMS320C672x提供的性能優(yōu)良的外部存儲器接口(EMIF)，分析了EMIF的特點(diǎn)和使用技巧，以TMS320C6722B型DSP為例，設(shè)計了EMIF與外部HY57V281620A型SDRAM和異步AM29LV800BB-90EC型Flash的硬件接口，并分析了EMIF訪問SDRAM和Flash時各控制寄存器配置的方法和具體步驟，列出了該配置命令下EMIF引腳與邏輯地址的對應(yīng)關(guān)系和具體的軟件編寫例程；
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基于MATLAB在FPGA 算法上浮點(diǎn)定點(diǎn)轉(zhuǎn)換的實現(xiàn)
- 基于MATLAB在FPGA 算法上浮點(diǎn)定點(diǎn)轉(zhuǎn)換的實現(xiàn),浮點(diǎn)定點(diǎn)轉(zhuǎn)換是在 FPGA 上實現(xiàn)算法時最困難的地方（圖 1）。雖然 MATLAB 是一種強(qiáng)大的運(yùn)算開發(fā)工具，但其許多優(yōu)點(diǎn)卻在浮點(diǎn)定點(diǎn)轉(zhuǎn)換過程中被降低了。例如，由于定點(diǎn)算術(shù)中精度較低，新的數(shù)學(xué)誤差被引入算法。您必須重
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基于FPGA的復(fù)數(shù)浮點(diǎn)協(xié)方差矩陣實現(xiàn)
- 基于FPGA的協(xié)方差矩陣運(yùn)算的實現(xiàn)大多采用的是定點(diǎn)計算方式，在運(yùn)算過程中，存在數(shù)據(jù)處理動態(tài)范圍小，容易溢出，截斷誤差等問題。加之以空間譜估計為研究背景的協(xié)方差矩陣運(yùn)算，大多得到的是針對特殊陣列模型的實對稱矩陣，不具備通用性。針對定點(diǎn)運(yùn)算的不足和該運(yùn)算的適用范圍，研究了浮點(diǎn)運(yùn)算和復(fù)數(shù)運(yùn)算的特點(diǎn)，提出了基于復(fù)數(shù)矢量的浮點(diǎn)協(xié)方差運(yùn)算的FPGA實現(xiàn)方案。在Altera＼stratix＼EP1S20F780C7中的仿真和調(diào)試結(jié)果表明了該方案的有效性。
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高速流水線浮點(diǎn)加法器的FPGA實現(xiàn)
- 本工程設(shè)計完全符合IP核設(shè)計的規(guī)范流程，而且完成了Verilog HDL建模、功能仿真、綜合、時序仿真等IP核設(shè)計的整個過程，電路功能正確。實際上，本系統(tǒng)在布局布線后，其系統(tǒng)的最高時鐘頻率可達(dá)80MHz。雖然使用浮點(diǎn)數(shù)會導(dǎo)致舍入誤差，但這種誤差很小，可以忽略。實踐證明，本工程利用流水線結(jié)構(gòu)，方便地實現(xiàn)了高速、連續(xù)、大數(shù)據(jù)量浮點(diǎn)數(shù)的加法運(yùn)算，而且設(shè)計結(jié)構(gòu)合理，性能優(yōu)異，可以應(yīng)用在高速信號處理系統(tǒng)中。
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浮點(diǎn)DSC使控制系統(tǒng)如虎添翼
- DSC（Digital signal controller，數(shù)字信號控制器）是一種面向高端嵌入式系統(tǒng)的最先進(jìn)的單片控制處理器?；诟↑c(diǎn)架構(gòu)的DSC具有更快的處理速度，所需的程序儲存容量更少，支持更高級的有助于節(jié)省功耗的計算算法，同時進(jìn)一步擴(kuò)展了系統(tǒng)的性能。浮點(diǎn)編程比定點(diǎn)編程的速度更快，SoC（system-on-a-chip，片上系統(tǒng)）的集成方式能夠有效控制板級空間、元件數(shù)量和整體系統(tǒng)開銷。 隨著嵌入式系統(tǒng)承擔(dān)的任務(wù)越來越復(fù)雜，不論是降低功耗還是實現(xiàn)諸如汽車導(dǎo)航之類的新功能，它們都需要具有更高性
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定點(diǎn)dsp與浮點(diǎn)dsp的比較
- 定點(diǎn)運(yùn)算DSP在應(yīng)用中已取得了極大的成功，而且仍然是DSP應(yīng)用的主體。然而，隨著對DSP處理速度與精度、存儲器容量、編程的靈活性和方便性要求的不斷提高、自80年代中后期以來，各DSP生產(chǎn)廠家陸續(xù)推出了各自的32bit浮點(diǎn)運(yùn)算DSP。 和定點(diǎn)運(yùn)算DSP相比，浮點(diǎn)運(yùn)算DSP具有許多優(yōu)越性： 浮點(diǎn)運(yùn)算DSP比定點(diǎn)運(yùn)算DSP的動態(tài)范圍要大很多。定點(diǎn)DSP的字長每增加1bit,動態(tài)范
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ARM體系下浮點(diǎn)數(shù)Middle-Endian問題的處理
- 隨著嵌入式微處理器芯片性能的日益提高，嵌入式設(shè)備也得到了廣泛的應(yīng)用。隨著應(yīng)用的擴(kuò)展，嵌入式軟件開發(fā)也呈現(xiàn)出功能多樣化、平臺多樣化、體系結(jié)構(gòu)多樣化的特點(diǎn)。 由于可移植性好，相當(dāng)一部分嵌入式軟件都是用C/C++語言開發(fā)的，而C/C++語言編寫的程序中數(shù)據(jù)存儲字節(jié)順序是與編譯平臺所用的CPU相關(guān)的，所以嵌入式軟件移植過程中，數(shù)據(jù)存儲字節(jié)順序是需要重點(diǎn)處理的地方。 在嵌入式GIS軟件從x86體系結(jié)構(gòu)下移植到ARM體系結(jié)構(gòu)的過程中，遇到了浮點(diǎn)數(shù)據(jù)存儲字節(jié)順序的問題。該問題既不是Big-Endian，
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浮點(diǎn)介紹
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