乘法器 文章 進入乘法器技術社區(qū)
三模冗余乘法器的設計與實現(xiàn)
- 現(xiàn)場可編程門陣列(Field Programmable Gate Array，F(xiàn)PGA)可通過用戶軟件編程來配置生成硬件電路，極大提高了電子系統(tǒng)設計中的靈活性和通用性，因而被廣泛應用于航天、通信、醫(yī)療和工控等重要領域。但在空間環(huán)境中，基于SRAM的FPGA容易受SEU(Single Event Upset)和SETs(Single Event Transients)的影響，從而導致系統(tǒng)故障。DMR(Dual Modular Redundancy)和TMR(Triple Modular Redundancy
- 關鍵字： 乘法器 FPGA
高速可擴展的Montgomery乘法器設計方案
- 本文提出一種高速可擴展的Montgomery乘法器設計方案，該方案是在Tenca提出的Booth-8 Montgomery模乘法器的基礎上，采用Booth-64編碼進行改進，使速度平均提高了48%。同時對數(shù)據(jù)通路進行了優(yōu)化，使得流水線數(shù)據(jù)通路的
- 關鍵字： Montgomery 乘法器 設計方案
基于FPGA的24×24位低功耗乘法器的設計
- 通過對現(xiàn)有編碼算法的改進，提出一種新的編碼算法，它降低功耗的方法是通過減少部分積的數(shù)量來實現(xiàn)的。因為乘法器的運算主要是部分積的相加，因此，減少部分積的數(shù)量可以降低乘法器中加法器的數(shù)量，從而實現(xiàn)功耗的減低。在部分積的累加過程中．又對用到的傳統(tǒng)全加器和半加器進行了必要的改進，避免了CMOS輸入信號不必要的翻轉，從而降低了乘法器的動態(tài)功耗。通過在Altera公司的FPGA芯片EP2CTOF896C中進行功耗測試，給出了測試結果，并與現(xiàn)有的兩種編碼算法進行了比較。功耗分別降低3．5％和8．4％。
- 關鍵字： FPGA 24位 低功耗 乘法器
OFDM信道調(diào)制解調(diào)的仿真及其FPGA設計
- OFDM(正交頻分復用)是一種高效的多載波調(diào)制技術，其最大的特點是傳輸速率高，具有很強的抗碼間干擾和信道選擇性...
- 關鍵字： FPGA器件 調(diào)制解調(diào) 比例因子 FPGA實現(xiàn) 傅里葉變換 正交頻分復用 乘法器 多載波調(diào)制 COFDM DFT
高效FPGA乘法器在無線基站中的使用
- 基于WiMax及其派生標準的新興寬帶無線協(xié)議需要越來越高的吞吐量和數(shù)據(jù)速率。這些協(xié)議提出的快速芯片速率和數(shù)字射頻處理可以在使用FPGA方案的硬件上得到最佳的實現(xiàn)。 FPGA非常適合作為高性能、高性價比的解決方案來實現(xiàn)這些物理層協(xié)議中的數(shù)字功能，因為它們包括以下豐富的資源： 1.DSP模塊，可以用來實現(xiàn)各種FIR濾波和FFT/IFFT操作所要求的乘法器和加法器/累加器功能； 2. SERDES收發(fā)器，可以支持無線前端與基帶數(shù)字板之間的CPRI和OBSAI接口； 3. 重要的FPG
- 關鍵字： FPGA 乘法器 無線 基站 WiMax DSP IP核
乘法器介紹
乘法器
乘法器（multiplier）是一種完成兩個互不相關的模擬信號相乘作用的電子器件。它可以將兩個二進制數(shù)相乘。它是由更基本的加法器組成的。
目錄
1簡介
2作用
3類型
·模擬乘法器
·硬件乘法器
1簡介
乘法器（multiplier）可以通過使用一系列計算機算數(shù)技術來實現(xiàn)。大多數(shù)的技術涉及了對部分積（partial product） [ 查看詳細 ]
乘法器電路
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