四倍頻鑒相計(jì)數(shù)器的VHDL程序代碼如下：

　　5 系統(tǒng)仿真

　　圖4為系統(tǒng)仿真結(jié)果。當(dāng)譯碼器控制信號(hào)AB=00時(shí)，可看出 A1超前B1，所以軸1正轉(zhuǎn)；B2超前A2所以軸2反轉(zhuǎn)。

　　三態(tài)門使能信號(hào)EN=1時(shí)，數(shù)據(jù)選擇器選通G口所對(duì)應(yīng)的汁數(shù)器，即軸2，清零F口對(duì)應(yīng)計(jì)數(shù)器，即對(duì)軸1清零。并將計(jì)數(shù)結(jié)果傳輸?shù)娇偩€，輸出信號(hào)H從FFF 變化到FF8表明軸2反轉(zhuǎn)，因此汁數(shù)器逆向計(jì)數(shù)。同時(shí)在AB譯碼器控制信號(hào)改變時(shí)和軸1，軸2正反轉(zhuǎn)的其他情況時(shí)，仿真結(jié)果均正確，滿足雙軸位置檢測(cè)系統(tǒng)設(shè)計(jì)。

　　6 結(jié)束語(yǔ)

　　在現(xiàn)代數(shù)控系統(tǒng)中，采用 CPLD實(shí)現(xiàn)位置檢測(cè)系統(tǒng)已成為主流。新一代CPLD產(chǎn)品MAX II EPM570以面積小、集成度高和 GPIO口多等特點(diǎn)使得電路板集成度和抗干擾性都得以提高，方便結(jié)合DSP控制伺服電機(jī)位臀。總之，CPLD器件的發(fā)展使得邏輯電子電路的設(shè)計(jì)更靈活、方便。它將推動(dòng)數(shù)控機(jī)床甚至工業(yè)各領(lǐng)域的發(fā)展。