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CAST和Achronix使用無損壓縮IP支持從數(shù)據(jù)中心到邊緣的數(shù)據(jù)處理

作者: 時間:2018-05-02 來源:電子產(chǎn)品世界 收藏

  基于現(xiàn)場可編程門陣列()的硬件加速器器件及嵌入式(e)領域內(nèi)領導性企業(yè)Achronix半導體公司(Achronix Semiconductor Corporation)日前宣布:與專注于為電子系統(tǒng)設計人員提供半導體IP的半導體知識產(chǎn)權公司 Incorporated達成合作;的高性能無損壓縮IP已經(jīng)被植入,以支持Achronix 的FPGA產(chǎn)品組合,用來完成數(shù)據(jù)中心和移動邊緣間數(shù)據(jù)傳輸?shù)母咝幚怼?/p>本文引用地址:http://m.ptau.cn/article/201805/379310.htm

  為Deflate、GZIP和ZLIB等無損壓縮工具提供標準的硬件實現(xiàn),它們與用于壓縮或解壓的軟件實現(xiàn)方式兼容。ZipAccel內(nèi)核提供的硬件實現(xiàn)可提供高達100Gbps的高吞吐量,且擁有非常高的壓縮性能和低延遲。將其與Achronix的Speedcore eFPGA技術耦合在一起,可實現(xiàn)一種可更加便捷地移動和存儲大數(shù)據(jù)的高性能、低功耗解決方案。

  隨著帶有解析的應用呈現(xiàn)爆炸式增長,通過帶寬有限的通信通道去傳輸越來越多的信息廣泛地出現(xiàn)在從汽車系統(tǒng)到大型金融機構等很多場景中。傳輸數(shù)據(jù)的成本和功耗變得越來越重要,使用Achronix eFPGA來實現(xiàn)的壓縮功能可將功耗降到最低并使網(wǎng)絡能力最大化。在客制化SoC中,將CAST壓縮IP和Speedcore eFPGA IP結(jié)合在一起,可有效地提升可實現(xiàn)的吞吐量;此外,開發(fā)人員可利用eFPGA去快速且高效地實現(xiàn)數(shù)據(jù)處理算法。

  為了應對系統(tǒng)的特定吞吐量、存儲和延遲需求,能夠在eFPGA中優(yōu)化壓縮算法,將使該解決方案成為數(shù)百種應用場景的可選技術。這不僅可以增加吞吐量,而且可以實現(xiàn)昂貴的內(nèi)存存儲空間的顯著節(jié)省。

  “我們非常高興能夠與CAST合作,來進一步豐富Achronix的合作伙伴計劃,” Achronix產(chǎn)品規(guī)劃和業(yè)務拓展高級總監(jiān)Mike Fitton說道?!澳軌蛟谖覀兊膃FPGA中將CAST的高吞吐量壓縮內(nèi)核實例化,將支持帶有Speedcore的ASIC和SoC去有效地滿足數(shù)據(jù)服務市場。由于有了eFPGA IP來作為面向特定工作負載的、可重復編程的硬件加速器,從而使包括壓縮以及包括數(shù)據(jù)解析等全新算法即刻被快速實現(xiàn)。Speedcore eFPGA的高性能加上其巨大的市場牽引力使其成為該類應用的理想選擇?!?/p>

  “CAST很高興地將內(nèi)核授權給Achronix的客戶,他們將受益于Achronix的獨特架構,可以為全新的算法提供高度靈活性和永不過時的能力,并實現(xiàn)快速上市,”CAST有限公司首席執(zhí)行官Nikos D. Zervas評論道。“通過為Achronix FPGA工具鏈和架構提供經(jīng)過驗證的IP解決方案,為我們那些要求在Achronix的FPGA和eFPGA中實現(xiàn)這些功能的客戶節(jié)省了開發(fā)時間。該IP已被進一步優(yōu)化以充分利用Achronix的FPGA架構來實現(xiàn)加速并縮減芯片面積。”



關鍵詞: CAST FPGA

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