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DVB-C解交織器的FPGA實現(xiàn)

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作者:相海英 林濤 時間:2007-01-15 來源:電子設計應用 收藏
卷積交織和解交織原理簡介

系統(tǒng)當中,實際信道中的突發(fā)錯誤往往是由脈沖干擾、多徑衰落引起的,在統(tǒng)計上是相關的,所以一旦出現(xiàn)不能糾正的錯誤時,這種錯誤將連續(xù)存在。因此在系統(tǒng)里,采用了卷積交織來解決這種問題。它以一定規(guī)律擾亂源符號數(shù)據(jù)的時間順序,使其相關性減弱,然后將其送入信道,解交織器按相反規(guī)律恢復出源符號數(shù)據(jù)。

的卷積交織和解交織原理為:交織由I=12(I為交織深度)個分支構成。每個分支的延時逐漸遞增,遞增的單元數(shù)M=n/I=204/12=17(M為交織基數(shù))。這里的數(shù)據(jù)單位為字節(jié)。0支路無延時,1支路延時17個符號周期,11支路則延時l7



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