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基于SOPC的SPWM脈沖發(fā)生器的實(shí)現(xiàn)

作者: 時(shí)間:2010-07-05 來源:網(wǎng)絡(luò) 收藏

死區(qū)產(chǎn)生部分同樣具有非常重要的作用,通過比較產(chǎn)生的波形上下沿相互對(duì)應(yīng),而沒有將其錯(cuò)開一定的時(shí)間。如果這樣的直接送入智能功率模塊,就會(huì)導(dǎo)致其上下兩個(gè)橋臂直通而短路。必須在開關(guān)管開關(guān)通斷切換時(shí)設(shè)置一段時(shí)間使上下橋臂滿足同時(shí)關(guān)斷,即設(shè)置通常所說的死區(qū)電路。死區(qū)部分的輸入是來自比較部分輸出結(jié)果的一路波,輸出是兩路互補(bǔ)的帶一定死區(qū)時(shí)間的SPWM波。本系統(tǒng)中,設(shè)計(jì)的死區(qū)時(shí)間為2μs。部分代碼如下。

在QaultusⅡ軟件中完成頂層文件的編譯后,生成.pof文件和.sof文件,將編譯產(chǎn)生的.sof文件通過JTAG下載線下載配置到中。圖5為死區(qū)時(shí)間設(shè)定為2μs的時(shí)候利用邏輯分析儀測(cè)試的SPWM波形的情況。v為不加死區(qū)時(shí)間的單相SPWM波形,pa與pb是死區(qū)部分的輸出,是兩路互補(bǔ)的帶一定死區(qū)時(shí)間的SPWM波。

本文引用地址:http://m.ptau.cn/article/180716.htm



3 結(jié)束語
本文提出一種系統(tǒng)SPWM數(shù)字化自然采樣的方案,并給出具體的方法。該電路通過系統(tǒng)可編程芯片。用Verilog HDL硬件表述語言完成了功能模塊的設(shè)計(jì)實(shí)現(xiàn),使得電路簡(jiǎn)單,可靠性高,穩(wěn)定性好。同時(shí),由系統(tǒng)實(shí)現(xiàn)的此SPWM脈沖,設(shè)計(jì)靈活,可在線編程,可根據(jù)不同要求的工作場(chǎng)合進(jìn)行系統(tǒng)參數(shù)的修改。


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