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FPGA設(shè)計(jì)頻率的計(jì)算方法

作者: 時間:2011-02-18 來源:網(wǎng)絡(luò) 收藏

  解決的 Tlogic 以后,我們來看看Troute 如何來計(jì)算。由于Xilinx 和Altera 在走線資源的設(shè)計(jì)上并不一樣,并且Xilinx 沒有給出布線延時的模型,因此更難于分析,不過好在業(yè)內(nèi)對布線延時與邏輯延時的統(tǒng)計(jì)分析表明,邏輯延時與布線延時的比值約為1:1 到1:2.由于我們所選用的芯片大量的已經(jīng)進(jìn)入0.18um 和0.13um 深亞微米的工藝,因此我們?nèi)∵壿嬔訒r與布線延時的比值為1:2.

  Troute = 2 * Tlogic

  Tmax = Tco + Tlogic + Troute + Tsu

  = Tco + Tsu + 3 * Tlogic

  = Tco + Tsu + 12 * Tlut

  下表是我們常用的一些 Xilinx 和Altera 器件的性能估算。我們選取的是各個系列中的最低的速度等級。由于Altera 的APEX ,APEX II 系列器件的不同規(guī)模的參數(shù)不同,我們選取EP20K400E 和 EP2A15 作代表。

Tsu ( ns )Tco ( ns )Tlut ( ns )Fmax
Spartent II-50.71.30.796 M
Virtex E-60.631.00.47137M
Virtex II-40.370.570.44160M
Virtex II Pro -50.290.400.37193M
APEX E-3 #0.230.321.0179M
APEX II-9##0.330.230.7112M
Stratix -70.0110.2020.527153M

  # 以EP20K400E-3 的數(shù)據(jù)計(jì)算得出。

  ## 以 EP2A15-9 的數(shù)據(jù)計(jì)算得出。


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