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CPLD的串口通信設(shè)計(jì)

一、硬件電路設(shè)計(jì)　　本文選用CPLD 是ALTERA 公司的EPM240T100，結(jié)合MAX232 接口芯片進(jìn)行串口通信設(shè)計(jì)，框圖如下圖1 所示。　　　　圖1 CPLD串口通信模塊硬件設(shè)計(jì)　　二、VHDL程序模塊設(shè)計(jì)及描述　　使用VHDL 對(duì)CPL
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嵌入式系統(tǒng)的USB虛擬串口設(shè)計(jì)

嵌入式系統(tǒng)的USB虛擬串口設(shè)計(jì),現(xiàn)代嵌入式系統(tǒng)中，異步串行通信接口往往作為標(biāo)準(zhǔn)外設(shè)出現(xiàn)在單片機(jī)和嵌入式系統(tǒng)中。但是隨著個(gè)人計(jì)算機(jī)通用外圍設(shè)備越來(lái)越少地使用串口，串口正在逐漸從個(gè)人計(jì)算機(jī)特別是便攜式電腦上消失。于是嵌入式開(kāi)發(fā)人員常常發(fā)
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基于CH341A的USB串口通訊設(shè)計(jì)

摘要：為解決當(dāng)前計(jì)算機(jī)串行通訊接口只有USB，難以滿足舊型號(hào)設(shè)備或某些單片機(jī)要求RS232通訊的問(wèn)題，設(shè)計(jì)出兩款RS232／USB電路。采用CH341A與MAX223集成電路芯片構(gòu)建標(biāo)準(zhǔn)9線RS232／USB通用接口轉(zhuǎn)換器，無(wú)需編程。采用
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模擬串口的C語(yǔ)言源程序代碼

本程序是模擬串口硬件機(jī)制寫的，使用時(shí)可設(shè)一定時(shí)中斷，時(shí)間間隔為1/4波特率，每中斷一次調(diào)用一次接收函數(shù)，每中斷4次調(diào)用一次發(fā)送函數(shù),不過(guò).對(duì)單片機(jī)來(lái)說(shuō)時(shí)鐘并須要快.要知道9600的波特率的每個(gè)BIT的時(shí)間間隔是104
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以太網(wǎng)串口服務(wù)器ESP904的特性及其在ROV上的應(yīng)用

摘要：介紹了以太網(wǎng)串口服務(wù)器ESP904的特點(diǎn)和性能，同時(shí)結(jié)合HYSUB130-4000 ROV系統(tǒng)開(kāi)發(fā)，介紹了ESP904在其控制系統(tǒng)上的應(yīng)用。
關(guān)鍵詞：以太網(wǎng)；串口服務(wù)器；ESP904；ROV

0 引言
隨著工業(yè)以太網(wǎng)的迅猛發(fā)展，
關(guān)鍵字：及其 ROV 應(yīng)用特性 ESP904 串口服務(wù)器以太網(wǎng)

基于FPGA+DSP的多串口數(shù)據(jù)通信的實(shí)現(xiàn)

摘要：串口傳輸常用于基于FPGA和DSP結(jié)構(gòu)的信號(hào)處理板和外部設(shè)備之間的數(shù)據(jù)交換。以GPS RTK定位應(yīng)用為基礎(chǔ)，針對(duì)單個(gè)串口全雙工傳輸不足以應(yīng)對(duì)多種數(shù)據(jù)類型同時(shí)輸入輸出的情形，設(shè)計(jì)并實(shí)現(xiàn)了一種面向多串口不同類型
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基于NIOS II的多串口數(shù)據(jù)通信的實(shí)現(xiàn)

串口傳輸常用于基于FPGA和DSP結(jié)構(gòu)的信號(hào)處理板和外部設(shè)備之間的數(shù)據(jù)交換。以GPS RTK定位應(yīng)用為基礎(chǔ)，針對(duì)單個(gè)串口全雙工傳輸不足以應(yīng)對(duì)多種數(shù)據(jù)類型同時(shí)輸入輸出的情形，設(shè)計(jì)并實(shí)現(xiàn)了一種面向多串口不同類型數(shù)據(jù)的傳輸方案。該方案通過(guò)增加串口控制寄存器實(shí)現(xiàn)單個(gè)中斷信號(hào)即可控制所有串口，采用乒乓交替讀寫實(shí)現(xiàn)數(shù)據(jù)持續(xù)高速輸入。測(cè)試表明該方案可獨(dú)立對(duì)各串口進(jìn)行配置，可同時(shí)實(shí)現(xiàn)GPS定位結(jié)果、差分GPS修正數(shù)據(jù)與外界的交換以及用戶控制命令的輸入，并且可減少硬件調(diào)試時(shí)間，節(jié)約硬件資源。
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嵌入式實(shí)時(shí)操作系統(tǒng)μC／OS-II串口通信的設(shè)計(jì)與實(shí)現(xiàn)

摘要：為解決實(shí)時(shí)操作系統(tǒng)mu;C／OS-II串口通信設(shè)計(jì)中信號(hào)量、消息郵箱使用方法的問(wèn)題，提出了一種以STM32V評(píng)估板為硬件平臺(tái)和mu;C／OS-Ⅱ的串口通信程序設(shè)計(jì)方案。該方案采用Cortex-M3架構(gòu)的ARM處理器STM32F103VB作
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設(shè)計(jì)RS232串口A/D模數(shù)轉(zhuǎn)換數(shù)碼管

RS232串口數(shù)顯表頭內(nèi)部采用10位分辨率的A/D轉(zhuǎn)換專用芯片，可對(duì)外部輸入的0-5V直流模擬信號(hào)進(jìn)行實(shí)時(shí)數(shù)據(jù)采集，通 ...
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實(shí)現(xiàn)基于TCP／IP的多串口轉(zhuǎn)換網(wǎng)關(guān)

隨著企業(yè)規(guī)模的擴(kuò)大和Internet技術(shù)的廣泛普及，全球各個(gè)領(lǐng)域的不同企業(yè)已經(jīng)對(duì)“讓設(shè)備聯(lián)網(wǎng)”達(dá)成共識(shí)，而在工業(yè)控制和通信設(shè)備中，更多的卻是符合RS232標(biāo)準(zhǔn)的串行口設(shè)備。如何將多個(gè)串行口的數(shù)據(jù)轉(zhuǎn)發(fā)到網(wǎng)絡(luò)
關(guān)鍵字：轉(zhuǎn)換網(wǎng)關(guān) 串口 IP 基于 TCP 實(shí)現(xiàn)

工業(yè)級(jí)串口服務(wù)器在智能小區(qū)抄表繳費(fèi)系統(tǒng)中的應(yīng)用

關(guān)鍵字：抄表串口 100Mbps 抄表系統(tǒng) 串口控制

XPORT以太網(wǎng)接口實(shí)現(xiàn)上電自動(dòng)配置的應(yīng)用

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基于單片機(jī)和串口的SD卡讀取平臺(tái)的設(shè)計(jì)

隨著現(xiàn)代電子技術(shù)的發(fā)展，各種存儲(chǔ)設(shè)備的應(yīng)用越來(lái)越廣泛。其中以SD存儲(chǔ)卡的應(yīng)用最為廣泛，但是由于在傳統(tǒng)的底層硬件體系結(jié)構(gòu)中，一個(gè)接口只能連接同種設(shè)備，這其實(shí)是對(duì)現(xiàn)有的資源的浪費(fèi)。在此提出一種通過(guò)AVR單片機(jī)和串行轉(zhuǎn)USB接口來(lái)讀取SD卡中數(shù)據(jù)的方案，真正做到了通過(guò)單片機(jī)和計(jì)算機(jī)對(duì)各種外設(shè)的雙向讀取，通過(guò)常規(guī)文件系統(tǒng)的讀取方式的改進(jìn)，能夠兼容各種外部設(shè)備使其便攜性進(jìn)一步增強(qiáng)，進(jìn)一步提高了已有資源的利用率，能通過(guò)單片機(jī)和計(jì)算機(jī)對(duì)存儲(chǔ)信息進(jìn)行有效的管理。實(shí)驗(yàn)證明單次讀取成功率能達(dá)到99．8％，因此在數(shù)據(jù)讀取的穩(wěn)定
關(guān)鍵字：平臺(tái) 設(shè)計(jì) 讀取 SD 單片機(jī) 串口基于

基于FPGA的PCI總線串口卡設(shè)計(jì)

為了方便外部設(shè)備與計(jì)算機(jī)進(jìn)行串口通信，提出一種基于FPGA的PCI總線串口卡設(shè)計(jì)。利用Altera公司的FPGA芯片EP1C6SQ240實(shí)現(xiàn)了串口和PCI總線的連接。介紹了用FPGA實(shí)現(xiàn)PCI接口、UART的方法，將PCI接口、UART的核心功能集中在FPGA上，使整個(gè)設(shè)計(jì)緊湊、小巧。該設(shè)計(jì)符合PCI 2.2規(guī)范，傳輸速率高，可廣泛應(yīng)用于各類測(cè)試設(shè)備、工廠自動(dòng)化、有線通信等領(lǐng)域。
關(guān)鍵字： FPGA PCI 總線串口