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實現(xiàn)FPGA與PC的串行通信

  • 電子設計應用2004年第10期摘    要：本文主要介紹了基于FPGA技術實現(xiàn)與PC串行通信的過程，給出了各個模塊的具體實現(xiàn)方法，分析了實現(xiàn)結果，驗證了串行通信的正確性。關鍵詞：串行通信；FPGA引言串行通信即串行數(shù)據(jù)傳輸，實現(xiàn)FPGA與PC的串行通信在實際中，特別是在FPGA的調試中有著很重要的應用。調試過程一般是先進行軟件編程仿真，然后將程序下載到芯片中驗證設計的正確性，目前還沒有更好的工具可以在下載后實時地對FPGA的工作情況和數(shù)據(jù)進行分析。通過串行通信，可以向FPGA
  • 關鍵字： FPGA  串行通信  

應用SoPC Builder開發(fā)電子系統(tǒng)

  • 電子設計應用2004年第9期摘    要：本文從系統(tǒng)總線設計、用戶自定義指令和FPGA協(xié)處理器的應用這三個方面詳細介紹了如何應用SoPC設計思想和SoPC Builder工具來開發(fā)電子系統(tǒng)。通過應用SoPC Builder開發(fā)工具，設計者可以擺脫傳統(tǒng)的、易于出錯的軟硬件設計細節(jié)，從而達到加快項目開發(fā)、縮短開發(fā)周期、節(jié)約開發(fā)成本的目的。關鍵詞：SoPC；SoPC Builder；FPGA引言隨著技術的進一步發(fā)展，SoC設計面臨著一些諸如如何進行軟硬件協(xié)同設計，如何縮短電子產(chǎn)品開
  • 關鍵字： FPGA  SoPC  SoPC  Builder  

基于FPGA的誤碼測試儀

  • 2004年4月A版 摘  要：本文提出了一種基于FPGA的誤碼測試方案，并在FPGA上實現(xiàn)了其功能。該方案不僅納入了“同步保護”的思想，同時對誤碼率量級的判斷也提出了一種簡化而又可行的方法。 關鍵詞：誤碼測試；FPGA；m序列；同步 　　在數(shù)字通信系統(tǒng)中，為了檢測系統(tǒng)的性能，通常使用誤碼分析儀對其誤碼性能進行測量。誤碼分析儀給工程實際應用帶來了極大的便利，比如它有豐富的測試接口和測試內(nèi)容，并能將結果直觀、準確的顯示出來。但是它的價格昂貴，并且通常需要另加外部輔助長線驅動電路才能與某些系統(tǒng)接
  • 關鍵字： FPGA  嵌入式  

Mentor Graphics公司與華為公司共建SoC軟硬件協(xié)同驗證環(huán)境

  • 日前，Mentor和華為共同宣布共同建立SOC軟硬件協(xié)同驗證環(huán)境。旨在加強SoC驗證方面雙方的全面合作。事先，華為已經(jīng)利用Mentor公司提供的Seamless軟硬件協(xié)同驗證方案成功建立了ARM-based SoC驗證環(huán)境。利用Seamless協(xié)同驗證環(huán)境，華為已經(jīng)成功調試，并解決了多款基于ARM7TDMI、 ARM926ejs、Power PC的SoC芯片軟硬件接口問題。華為早在上個世紀90年代就認識到SoC的功能驗證比傳統(tǒng)的ASIC的功能驗證更具有挑戰(zhàn)性，需要付出更多的仿真努力，同時產(chǎn)品的開發(fā)周期也更
  • 關鍵字： Mentor  Graphics  SoC  ASIC  

北京集成電路設計園選用Cadence SoC Encounter設計平臺

  • 美國Cadence設計系統(tǒng)公司公司（紐約證券交易所代碼：CDN）董事會主席Ray Bingham先生一行，到北京集成電路設計園訪問, 設計園公司總經(jīng)理郝偉亞先生詳細介紹了設計園以及北京集成電路設計產(chǎn)業(yè)發(fā)展情況。Ray Bingham先生表示，Cadence長期致力于中國電子產(chǎn)業(yè)的發(fā)展，支持北京集成電路產(chǎn)業(yè)的發(fā)展，對于作為中國7個國家IC設計基地之一的北京集成電路設計園，擴展其數(shù)字設計平臺，選用Cadence SoC Encounter為實現(xiàn)很復雜、高性能的芯片提供經(jīng)過驗證的設計工具，應對納米技術挑戰(zhàn)，感
  • 關鍵字： Cadence  SoC  ASIC  

高速SoC單片機C8051F

  • 美國Cygnal公司專門從事混合信號系統(tǒng)芯片(SoC)單片機的設計與制造。公司更新了原51單片機結構，設計了具有自主產(chǎn)權的CIP-51內(nèi)核，運行速度高達每秒25MIPS?，F(xiàn)已設計并為市場提供了29個品種的C8051F系列SoC單片機，預計今年年內(nèi)還將完成20多個新的SoC單片機的設計。 C8051F系列是集成的混合信號系統(tǒng)芯片SoC單片機，具有與MCS-51內(nèi)核及指令集完全兼容的微控制器，除了具有標準8051的數(shù)字外設部件之外，片內(nèi)還集成了數(shù)據(jù)采集和控制系統(tǒng)中常用的模擬部件和其它數(shù)字外設及功能部件(參見圖
  • 關鍵字： SoC  ASIC  

2004年，賽靈思成立20周年慶典

  • 　　2004年，賽靈思成立20周年慶典。通過表彰員工、用戶、股東、合作伙伴和當?shù)厣鐓^(qū)，公司慶祝了它的20歲生日。
  • 關鍵字： 賽靈思  FPGA  

橢圓曲線加密的硬件實現(xiàn)

  • 摘 要： 橢圓曲線加密是一種目前已知的所有公鑰密碼體制中能夠提供最高比特強度的一種公鑰體制。在FPGA實現(xiàn)橢圓曲線加密系統(tǒng)時，基于GF(2)的多項式有限域中的乘法、求逆運算是其中的兩大難點。本文提供了一種橢圓曲線加密的FPGA實現(xiàn)的結構，著重討論了基于GF(2)的多項式有限域中的乘法、求逆運算的實現(xiàn)，并與軟件實現(xiàn)的性能進行了比較。關鍵詞： FPGA；多項式有限域；橢圓曲線加密系統(tǒng)加密的安全性從數(shù)論的角度來說，任何公鑰密碼系統(tǒng)都建立在一個NP(無法處理的問題)的基礎上，即對于特定的問題，沒有辦法找到一個
  • 關鍵字： FPGA  多項式有限域  橢圓曲線加密系統(tǒng)  

WCDMA速率適配算法的FPGA實現(xiàn)

  • 摘 要： 為了支持多媒體業(yè)務的傳輸，第三代移動通信WCDMA系統(tǒng)采用了獨特的編碼復接方案，同時也加大了系統(tǒng)復雜度，并引入了較長的處理時延。速率適配算法是業(yè)務復用方案的核心算法。本文具體提出了在FPGA中進行模塊合并、產(chǎn)生鑿孔圖樣進行比特積攢搬移的實現(xiàn)方案，縮短了處理延時，大大提高了系統(tǒng)的處理能力。關鍵詞：編碼復接；速率適配；FPGA；鑿孔圖樣；保留比特搬移引言隨著因特網(wǎng)爆炸性的增長以及各種無線業(yè)務需求的增加，傳統(tǒng)的無線通信網(wǎng)已經(jīng)越來越無法適應人們的需要。因此，以大容量、高數(shù)據(jù)率和承載多媒體業(yè)務為目的的
  • 關鍵字： FPGA  保留比特搬移  編碼復接  速率適配  鑿孔圖樣  

virterx技術白皮書

  • 平臺FPGA的興起隨著Virtex系列在片上系統(tǒng)（SoC）應用中的廣泛應用,賽靈思（Xilinx）公司引入了平臺FPGA（Platform FPGA）的概念。作為領先的可編程邏輯供應商，賽靈思公司利用其基于Virtex的支持可編程邏輯、I/O和計算處理的多功能器件，幫助業(yè)界涉足并確立了基于FPGA的SoC設計方法。通過實現(xiàn)大量基于FPGA的RISC處理器和處理器內(nèi)核，賽靈思在這方面已經(jīng)證實了自己的實力。最早的例子是于1991年實現(xiàn)Philip Freidin的RISC4005/R16 FPGA處理器。Vi
  • 關鍵字： FPGA  Xilinx  

FPGA實現(xiàn)的FIR算法在汽車動態(tài)稱重儀表中的應用

  • 摘 要： 本文介紹了用FPGA實現(xiàn)的FIR算法，并對這種算法應用于汽車動態(tài)稱重儀表中的結果做了分析。實踐證明此算法用于動態(tài)稱重具有良好的效果。關鍵詞： FPGA；FIR；動態(tài)稱重引言車輛在動態(tài)稱重時，作用在平臺上的力除真實軸重外，還有許多因素產(chǎn)生的干擾力，如：車速、車輛自身諧振、路面激勵、輪胎驅動力等，給動態(tài)稱重實現(xiàn)高精度測量造成很大困難。若在消除干擾的過程中采用模擬方法濾波，參數(shù)則不能過大，否則將產(chǎn)生過大的延遲導致不能實現(xiàn)實時處理，從而造成濾波后的信號仍然含有相當一部分的噪聲。所以必須采用數(shù)字濾波消
  • 關鍵字： FIR  FPGA  動態(tài)稱重  

英特爾成功開發(fā)480Mbps之UWB收發(fā)器

  • 日前(4月7日～8日)在甫結束的日本2004年英特爾IDF論壇中，英特爾首度展示了480Mbps的UWB無線傳輸，打破該公司在去年實現(xiàn)的252Mbps紀錄。據(jù)日經(jīng)BP社消息，英特爾是采用FPGA設計LSI收發(fā)器，這代表著可以使用CMOS技術，以低成本生無線USB收發(fā)器，無線傳輸技術是多頻帶OFDM（版本0.8），所用頻率3GHz～5GHz，使用3個528MHz的頻帶
  • 關鍵字： 英特爾  FPGA  Wisair  

SoC處理器的定標原則

  • 半導體器件定標(scaling)在量上的不斷進展蘊育著系統(tǒng)級芯片(SoC)器件在設計和結構上質的深刻變化。IC器件定標可以加強功率效率、增加帶寬和顯著改進功能集成性，而要挖掘出硅的全部性能潛力，還須在設計復雜性管理和改進設計可重用性方面做同樣的努力。代表ITRS對半導體定標的一致觀點的一個簡易技術模型示出了芯片設計上一系列重大變化。較高層次的可編程性可以緩解經(jīng)濟上的壓力。專用處理器性能的不斷提高和器件的自動生成將使處理器芯核在SoC結構體系中發(fā)揮重大作用，諸如從高性能控制到以前只能由硬連接邏輯才可以實現(xiàn)的
  • 關鍵字： SoC  SoC  ASIC  

全數(shù)字鎖相環(huán)的設計

  • 摘要：本文在說明全數(shù)字鎖相環(huán)的基礎上，提出了一種利用FPGA設計一階全數(shù)字鎖相環(huán)的方法，并給出了關鍵部件的RTL可綜合代碼，并結合本設計的一些仿真波形詳細描述了數(shù)字鎖相環(huán)的工作過程，最后對一些有關的問題進行了討論。關鍵詞：全數(shù)字鎖相環(huán)；DPLL；FSK；FPGA 引言鎖相環(huán)(PLL)技術在眾多領域得到了廣泛的應用。如信號處理，調制解調，時鐘同步，倍頻，頻率綜合等都應用到了鎖相環(huán)技術。傳統(tǒng)的鎖相環(huán)由模擬電路實現(xiàn)，而全數(shù)字鎖相環(huán)(DPLL)與傳統(tǒng)的模擬電路實現(xiàn)的PLL相比，具有精度高且不受溫度和電壓影響，環(huán)路
  • 關鍵字： DPLL  FPGA  FSK  全數(shù)字鎖相環(huán)  

Cypress微系統(tǒng)公司推出用于PSoCTM混合信號陣列的集成開發(fā)環(huán)境

  • 賽普拉斯半導體(Cypress Semiconductor)公司的子公司賽普拉斯微系統(tǒng)有限公司（Cypress MicroSystems）于今日宣布推出用于其可編程系統(tǒng)級芯片（PSOCTM）混合信號陣列的PSoC Designer 4.0集成開發(fā)環(huán)境（IDE）。PSoC Designer 4.0是一個完整的圖形成套工具，它通過提供“點擊”系統(tǒng)設計能力而為用戶利用PSoC的功能和靈活性給予了幫助。PSoC Designer 4.0提供了設備和應用程序編輯器以及一個簡單圖形用戶接口（GUI）下的編譯器、調試器
  • 關鍵字： 賽普拉斯  SoC  ASIC  
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