dpu asic 文章 進(jìn)入dpu asic技術(shù)社區(qū)
如何采用SystemVerilog來改善基于FPGA的ASIC原型
- ASIC在解決高性能復(fù)雜設(shè)計(jì)概念方面提供了一種解決方案,但是ASIC也是高投資風(fēng)險(xiǎn)的,如90nm ASIC/SoC設(shè)計(jì)大約需要2000萬美元開發(fā)成本.為了降低成本,現(xiàn)在可采用FPGA來實(shí)現(xiàn)ASIC.但是,但ASIC集成度較大時(shí),需要幾個(gè)FPGA來實(shí)現(xiàn),這就需要考慮如何來連接ASIC設(shè)計(jì)中所有的邏輯區(qū)塊.采用SystemVerilog,可以簡化這一問題.
- 關(guān)鍵字: SystemVerilog ASIC FPGA
ASIC中的異步時(shí)序設(shè)計(jì)
- 絕大部分的ASIC設(shè)計(jì)工程師在實(shí)際工作中都會遇到異步設(shè)計(jì)的問題,本文針對異步時(shí)序產(chǎn)生的問題,介紹了幾種同步的策略,特別是結(jié)繩法和異步FIFO的異步比較法都是比較新穎的方法。
- 關(guān)鍵字: ASIC
在選用FPGA進(jìn)行設(shè)計(jì)時(shí)如何降低功耗
- 傳統(tǒng)意義上,ASIC和CPLD是低功耗競爭中當(dāng)仁不讓的贏家。但是由于相對成本較高,且用戶對高端性能和額外邏輯的要求也越來越多,在低功耗應(yīng)用中使用CPLD正在失去優(yōu)勢。ASIC也面臨相同的風(fēng)險(xiǎn)。而例如FPGA這樣日益增長的可編程半導(dǎo)體器件正逐步成為備受青睞的解決方案。
- 關(guān)鍵字: 低功耗 ASIC CPLD 可編程半導(dǎo)體器件
ASIC設(shè)計(jì)中不可忽視的幾大問題

- ASIC的復(fù)雜性不斷提高,同時(shí)工藝在不斷地改進(jìn),如何在較短的時(shí)間內(nèi)開發(fā)一個(gè)穩(wěn)定的可重用的ASIC芯片的設(shè)計(jì),并且一次性流片成功,這需要一個(gè)成熟的ASIC的設(shè)計(jì)方法和開發(fā)流程?! ”疚慕Y(jié)合NCverilog,DesignCompile,Astro等ASIC設(shè)計(jì)所用到的EDA軟件,從工藝獨(dú)立性、系統(tǒng)的穩(wěn)定性、復(fù)雜性的角度對比各種ASIC的設(shè)計(jì)方法,介紹了在編碼設(shè)計(jì)、綜合設(shè)計(jì)、靜態(tài)時(shí)序分析和時(shí)序仿真等階段經(jīng)常忽視的問題以及避免的辦法,從而使得整個(gè)設(shè)計(jì)具有可控性?! ?nbsp;
- 關(guān)鍵字: ASIC
便攜式數(shù)據(jù)采集系統(tǒng)中ADC的選用指南
- 真實(shí)世界的應(yīng)用需要真實(shí)世界的物理連接,一般來說,這意味著模擬信號要在系統(tǒng)內(nèi)的某處被數(shù)字化處理,以便于微處理器、ASIC或FPGA采集數(shù)據(jù)并做出決策?;具x用標(biāo)準(zhǔn)當(dāng)選擇一款模擬數(shù)字轉(zhuǎn)換器(ADC)時(shí),大多數(shù)設(shè)計(jì)師似
- 關(guān)鍵字: 模數(shù)轉(zhuǎn)換器 SPI ASIC ADC
常見問題解答:賽靈思采用首個(gè)ASIC級UltraScale可編程架構(gòu)
- 1. 賽靈思將在2013年7月10日宣布推出什么產(chǎn)品? 賽靈思宣布20nm兩項(xiàng)新的行業(yè)第一,延續(xù)28nm工藝節(jié)點(diǎn)上一系列業(yè)界創(chuàng)新優(yōu)勢: middot; 賽靈思宣布開始投片半導(dǎo)體行業(yè)首款20nm器件以及投片PLD行業(yè)首款20nm All
- 關(guān)鍵字: UltraScale ASIC 賽靈思 可編程
在系統(tǒng)設(shè)計(jì)中的如何選擇半導(dǎo)體器件:ASIC,還是FPGA?
- 作為一個(gè)系統(tǒng)設(shè)計(jì)工程師,經(jīng)常會遇到這個(gè)問題:是選用ASIC還是FPGA?讓我們來看一看這兩者有什么不同。所謂ASIC,是專用集成電路(Application Specific Integrated Circuit)的簡稱,電子產(chǎn)品中,應(yīng)用非常廣泛。ASIC的
- 關(guān)鍵字: FPGA ASIC 系統(tǒng)設(shè)計(jì) 成本因素
智原發(fā)表PowerSlash(TM)硅智財(cái)于聯(lián)電55奈米超低功耗製程支援物聯(lián)網(wǎng)應(yīng)用開發(fā)
- 聯(lián)華電子今(12日)與ASIC設(shè)計(jì)服務(wù)暨IP研發(fā)銷售廠商智原科技(Faraday Technology Corporation,TWSE:3035)共同發(fā)表智原科技于聯(lián)電55奈米超低功耗製程(55ULP)的PowerSlash™基礎(chǔ)IP方案。智原PowerSlash™與聯(lián)電製程技術(shù)相互結(jié)合設(shè)計(jì),為超低功耗的無線應(yīng)用需求技術(shù)進(jìn)行優(yōu)化,滿足無線物聯(lián)網(wǎng)產(chǎn)品的電池長期壽命需求。 智原科技行銷暨投資副總于德旬表示:「物聯(lián)網(wǎng)應(yīng)用建構(gòu)過程中,效能往往受制于低功耗技術(shù)。而今透過聯(lián)電55奈
- 關(guān)鍵字: 聯(lián)華電子 ASIC
智原榮獲ISO9001 Plus品質(zhì)知識典范獎(jiǎng),高經(jīng)營品質(zhì)打造設(shè)計(jì)服務(wù)
- ASIC 設(shè)計(jì)服務(wù)暨 IP 研發(fā)銷售領(lǐng)導(dǎo)廠商-智原科技(Faraday Technology, TAIEX: 3035)于日前獲頒 ISO9001 Plus 典范獎(jiǎng)項(xiàng)。ISO9001:2015是ISO 15年來最大改版,能成為首批獲得SGS專業(yè)驗(yàn)證的廠商,是對智原在品質(zhì)承諾、經(jīng)營與職能發(fā)展表現(xiàn)上的高度肯定和最具體驗(yàn)證。 智原科技成立于1993年,累積20余年在 IP (矽智財(cái))與 ASIC 設(shè)計(jì)服務(wù)的豐富經(jīng)驗(yàn),不但自主產(chǎn)出了3,000多支的 IP,更有2,000多個(gè)專案的成功量產(chǎn)經(jīng)驗(yàn),客戶遍及臺
- 關(guān)鍵字: ASIC 智原科技
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