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用于混合信號VLSI的可擴(kuò)展JTAG控制器IP核設(shè)計(jì)

  • 正電子發(fā)射斷層成像系統(tǒng)(PET)前端讀出電路是數(shù)?;旌闲盘柍笠?guī)模集成電路芯片.針對多通道高性能PET專用集成電路芯片的特點(diǎn),采用JTAG控制器對該芯片進(jìn)行初始控制和輔助測試.采用TSMC 0.18μmCMOS工藝設(shè)計(jì)實(shí)現(xiàn)了一個(gè)可擴(kuò)展的JTAG控制器IP核,支持14組可擴(kuò)展控制信號和16個(gè)多位寄存器掃描鏈的讀/寫操作,并配備定制的底層驅(qū)動
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pet成像系統(tǒng)介紹

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