直接數(shù)字合成（dds）技術(shù) 文章進(jìn)入直接數(shù)字合成（dds）技術(shù)技術(shù)社區(qū)

石英晶體測(cè)試系統(tǒng)中DDS信號(hào)源設(shè)計(jì)

　　針對(duì)π網(wǎng)絡(luò)石英晶體參數(shù)測(cè)試系統(tǒng)，采用以STM32F103ZET6型ARM為MCU控制DDS產(chǎn)生激勵(lì)信號(hào)。該測(cè)試系統(tǒng)相對(duì)于傳統(tǒng)的PC機(jī)測(cè)試系統(tǒng)具有設(shè)備簡(jiǎn)單、操作方便，較之普通單片機(jī)測(cè)試系統(tǒng)又具有資源豐富、運(yùn)算速度更快等優(yōu)點(diǎn)。AD9852型DDS在ARM控制下能產(chǎn)生0～100 MHz掃頻信號(hào)，經(jīng)試驗(yàn)數(shù)據(jù)分析得到信號(hào)精度達(dá)到0.5×10-6，基本滿足設(shè)計(jì)要求。該系統(tǒng)將以其小巧、快速、操作方便、等優(yōu)點(diǎn)被廣泛采用。　　產(chǎn)生正弦激勵(lì)信號(hào)一般可以通過振蕩電路或直接數(shù)字頻率合成器(Direct
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基于DDS技術(shù)的波形發(fā)生器設(shè)計(jì)與仿真

　　1.引言　　DDS頻率合成器具有頻率分辨率高，輸出頻點(diǎn)多，可達(dá)2N個(gè)頻點(diǎn)(假設(shè)DDS相位累加器的字長(zhǎng)是N);頻率切換速度快，可達(dá)us量級(jí);頻率切換時(shí)相位連續(xù)的優(yōu)點(diǎn)，可以輸出寬帶正交信號(hào)，其輸出相位噪聲低，對(duì)參考頻率源的相位噪聲有改善作用;可以產(chǎn)生任意波形;全數(shù)字化實(shí)現(xiàn)，便于集成，體積小，重量輕。　　本文介紹了DDS的基本原理，同時(shí)針對(duì)DDS波形發(fā)生器的FPGA實(shí)現(xiàn)進(jìn)行了簡(jiǎn)要介紹，利用SignalTapII嵌入式邏輯分析儀對(duì)正弦波、三角波、方波、鋸齒波進(jìn)行仿真驗(yàn)證。　　2.DDS波形發(fā)生器的
關(guān)鍵字： DDS 波形發(fā)生器

基于FPGA+DDS的正弦信號(hào)發(fā)生器的設(shè)計(jì)

　　1971年，美國學(xué)者TIERNCY J、TADER C M和GOLD B在《A Digital Frequeney Synthesizer》一文中提出了以全數(shù)字技術(shù)，從相位概念出發(fā)直接合成所需波形的一種新的頻率合成原理，稱之為直接數(shù)字頻率合成器DDS(Direct Digitial Frequency Synthesis)[1].這是頻率合成技術(shù)的一次重大革命，但限于當(dāng)時(shí)微電子技術(shù)和數(shù)字信號(hào)處理技術(shù)的限制，DDS并沒有得到足夠的重視。隨著現(xiàn)代超大規(guī)模集成電路集成工藝的高速發(fā)展，數(shù)字頻率合成技術(shù)得到了質(zhì)
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基于DDS技術(shù)和單片機(jī)設(shè)計(jì)的射頻信號(hào)干擾器

　　文中介紹的干擾器能夠產(chǎn)生3種干擾信號(hào)：隨機(jī)干擾、點(diǎn)頻干擾和掃頻干擾，其中點(diǎn)頻干擾和掃頻干擾是基于單片機(jī)對(duì)DDS芯片AD9852的控制產(chǎn)生，整個(gè)系統(tǒng)的控制靈活、高效。測(cè)試結(jié)果表明，系統(tǒng)能夠準(zhǔn)確產(chǎn)生所需要的干擾信號(hào)，滿足抗干擾性能測(cè)試的需要。雖然本設(shè)計(jì)產(chǎn)生的干擾信號(hào)位于406 MHz頻段，但這樣的電路結(jié)構(gòu)也可用于其它頻段(需修改VCO、PLL等電路)，例如手機(jī)通信頻段，因此本電路結(jié)構(gòu)對(duì)其它頻段的應(yīng)用同樣具有借鑒意義。　　隨著電子設(shè)備的使用越來越普遍，電子設(shè)備之間的干擾問題也越來越突出，特別是通信設(shè)備的
關(guān)鍵字： DDS AD9852

基于DDS的短波射頻頻率源設(shè)計(jì)與實(shí)現(xiàn)

　　介紹了直接數(shù)字頻率合成(DDS)的結(jié)構(gòu)和原理，并將DDS技術(shù)應(yīng)用于短波射頻通信頻率源中。實(shí)現(xiàn)了一種基于單片機(jī)+DDS可編程低噪聲頻率源，輸出信號(hào)范圍46.5~75 MHz.實(shí)驗(yàn)結(jié)果表明，該頻率源具有頻率分辨率高、相位噪聲低等優(yōu)點(diǎn)，滿足短波射頻通信系統(tǒng)對(duì)頻率源的設(shè)計(jì)要求。　　頻率源是現(xiàn)代短波射頻通信系統(tǒng)的核心，對(duì)整個(gè)系統(tǒng)的正常運(yùn)行起著決定性的作用。作為射頻電路與系統(tǒng)的核心設(shè)備，頻率源的好壞關(guān)系著整個(gè)系統(tǒng)的穩(wěn)定性?，F(xiàn)在的頻率合成技術(shù)正朝著雜散和相位噪聲更低的方向發(fā)展，同時(shí)還要求有更寬的頻帶和更高的頻率
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基于AD9854和FPGA的頻率特性測(cè)試儀

　　摘要：基于零中頻正交解調(diào)原理的頻率特性測(cè)試儀，用于檢測(cè)被測(cè)網(wǎng)絡(luò)的幅頻特性和相頻特性。系統(tǒng)采用集成數(shù)字直接頻率合成器AD9854產(chǎn)生雙路恒幅正交余弦信號(hào)，作為掃頻信號(hào)源，以FPGA為控制核心和運(yùn)算平臺(tái)，結(jié)合濾波器、放大器、混頻器及ADC電路，實(shí)現(xiàn)對(duì)雙端口網(wǎng)絡(luò)在1-40MHz頻率范圍內(nèi)頻率特性的點(diǎn)頻和掃頻測(cè)量，并在LCD屏上實(shí)時(shí)顯示相頻特性曲線和幅頻特性曲線。　　引言　　AD9854數(shù)字合成器是高度集成的器件，它采用先進(jìn)的DDS技術(shù)，片內(nèi)整合了兩路高速、高性能正交D/A轉(zhuǎn)換器，在高穩(wěn)定度時(shí)鐘的驅(qū)動(dòng)
關(guān)鍵字： AD9854 FPGA 濾波器 DDS ADC 201504

多模多制式調(diào)制信號(hào)發(fā)生技術(shù)

　　摘要：隨著通信行業(yè)以及數(shù)字技術(shù)的不斷發(fā)展，市場(chǎng)上經(jīng)常需要多模通信信號(hào)或多制式數(shù)字調(diào)制信號(hào)發(fā)生器，本文介紹了采用軟件無線電思想，基于“DDR2+FPGA+DAC+DDS+寬帶調(diào)制器”的硬件結(jié)構(gòu)的信號(hào)發(fā)生裝置，實(shí)現(xiàn)了TD-SCDMA、WCDMA、TD-LTE、FDD-LTE等多模信號(hào)以及BPSK、QPSK、OQPSK、DQPSK、8PSK、16QAM、32QAM、64QAM、2FSK、4FSK、GMSK等數(shù)字調(diào)制信號(hào)的發(fā)生，能很好滿足現(xiàn)代信號(hào)模擬的實(shí)際需求。　　1 引言　　
關(guān)鍵字：多模調(diào)制信號(hào) FPGA DDS FIR濾波器 201504

【從零開始走進(jìn)FPGA】教你什么才是真正的任意分頻

　　一、為啥要說任意分頻　　也許FPGA中的第一個(gè)實(shí)驗(yàn)應(yīng)該是分頻實(shí)驗(yàn)，而不是流水燈，或者LCD1602的"Hello World"顯示，因?yàn)榉诸l的思想在FPGA中極為重要。當(dāng)初安排流水燈，只是為了能讓大家看到效果，來激發(fā)您的興趣(MCU的學(xué)習(xí)也是如此)。　　在大部分的教科書中，都會(huì)提到如何分頻，包括奇數(shù)分頻，偶數(shù)分頻，小數(shù)分頻等。有些教科書中也會(huì)講到任意分頻(半分頻，任意分?jǐn)?shù)分頻)原理，用的是相位與的電路，并不能辦到50%的占空比，也不是很靈活。　　但沒有一本教科書會(huì)講到精
關(guān)鍵字： FPGA DDS

X波段間接式頻率綜合器的設(shè)計(jì)

　　1 引言　　頻率源是所有電子系統(tǒng)(雷達(dá)、通訊、測(cè)控、導(dǎo)航等)的基本信號(hào)來源，其主要包括固定頻率源和合成頻率源兩類。其中合成頻率源又稱頻率合成(綜合)器，按其構(gòu)成方式可分為直接式和間接式。采用鎖相環(huán)(PLL)技術(shù)的間接頻率合成器目前應(yīng)用最為廣泛。直接模擬頻率合成器(DAS)采用倍頻器、分頻器、混頻器及微波開關(guān)來實(shí)現(xiàn)頻率合成，具有最優(yōu)的近端相位噪聲和高速捷變頻特性，但結(jié)構(gòu)復(fù)雜、成本昂貴的特點(diǎn)限制其只能應(yīng)用于雷達(dá)等高端領(lǐng)域。直接數(shù)字合成器(DDS)目前也得到了廣泛應(yīng)用，但高性能DDS產(chǎn)品的輸出頻率還有待
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基于DDS的頻譜分析儀設(shè)計(jì)

　　1 引言　　直接數(shù)字頻率合成(DDS)是近幾年一種新型的頻率合成法，其具有頻率切換速度快，頻率分辨率高，以及便于集成等優(yōu)點(diǎn)。在此，設(shè)計(jì)了基于DDS的頻譜分析儀，該頻譜分析儀依據(jù)外差原理，被測(cè)信號(hào)與本征頻率混頻，實(shí)現(xiàn)信號(hào)的頻譜分析。　　2 系統(tǒng)設(shè)計(jì) 　　圖1給出系統(tǒng)設(shè)計(jì)框圖，主要由本機(jī)振蕩電路、混頻電路、放大檢波電路、頻譜輸出顯示電路等組成。通過單片機(jī)和現(xiàn)場(chǎng)可編程門陣列(FPGA)共同控制AD985l，以產(chǎn)生正弦掃頻輸出信號(hào)，然后經(jīng)濾波、程控放大得到穩(wěn)定輸出，與經(jīng)放大處理的被測(cè)信號(hào)混頻，再經(jīng)放
關(guān)鍵字： DDS FPGA AD985l

C波段寬帶捷變頻率綜合器設(shè)計(jì)

　　摘要：本文介紹了一種C波段寬帶捷變頻率綜合器的設(shè)計(jì)方法，采用直接數(shù)字頻率合成器(DDS)實(shí)現(xiàn)頻率捷變，采用倍頻鏈路擴(kuò)展輸出帶寬，通過與鎖相環(huán)(PLL)合成產(chǎn)生的本振信號(hào)混頻將輸出頻率搬移到C波段。論述了DDS時(shí)鐘電路、倍頻鏈路以及混頻部分的設(shè)計(jì)方法，并給出了達(dá)到的主要技術(shù)指標(biāo)和測(cè)試結(jié)果。　　引言　　頻率合成器是現(xiàn)代通訊系統(tǒng)必不可少的關(guān)鍵電路，是電子系統(tǒng)的主要信號(hào)源，是決定電子系統(tǒng)性能的關(guān)鍵設(shè)備。隨著系統(tǒng)對(duì)頻率源的頻率穩(wěn)定度、頻譜純度、頻率范圍和輸出頻率個(gè)數(shù)的要求越來越高，高穩(wěn)定、低相位噪聲、
關(guān)鍵字：變頻率綜合器 DDS PLL C波段合成器 201410

基于FPGA的多路相干DDS信號(hào)源設(shè)計(jì)

摘要：傳統(tǒng)的多路同步信號(hào)源常采用單片機(jī)搭載多片專用DDS芯片配合實(shí)現(xiàn)。該技術(shù)實(shí)現(xiàn)復(fù)雜，且在要求各路同步相干可控時(shí)難以實(shí)現(xiàn)。本文在介紹了DDS原理的基礎(chǔ)上，給出了用Verilog_HDL語言實(shí)現(xiàn)相干多路DDS的工作原理、設(shè)計(jì)思路、電路結(jié)構(gòu)。利用Modelsim仿真驗(yàn)證了該設(shè)計(jì)的正確性，本設(shè)計(jì)具有調(diào)相方便，相位連續(xù)，頻率穩(wěn)定度高等優(yōu)點(diǎn)。關(guān)鍵詞：DDS;現(xiàn)場(chǎng)可編程門陣列(FPGA);相位累加器;Verilog_HDL 實(shí)現(xiàn)信號(hào)源的多路同步輸出且各路間擁有固定的相位關(guān)系，在雷達(dá)、通信等多領(lǐng)域有著重要的應(yīng)用。
關(guān)鍵字： FPGA DDS

基于AD9852的雷達(dá)回波模擬器設(shè)計(jì)

摘要基于直接數(shù)字頻率合成技術(shù)DDS的原理，分析了影響DDS頻率輸出的核心因素。在此基礎(chǔ)上仿真驗(yàn)證了相位累加器的位數(shù)對(duì)DDS頻率輸出的作用。介紹了一種DDS芯片AD9852并基于這種芯片提出了一種雷達(dá)回波模擬器的設(shè)計(jì)，并分析了DDS芯片的優(yōu)缺點(diǎn)。該設(shè)計(jì)能夠穩(wěn)定地產(chǎn)生70 MHz載頻的雷達(dá)回波，較好地模擬出所需回波。關(guān)鍵詞 DDS;相位累加器;AD9852 直接數(shù)字頻率合成技術(shù)(DDS)是繼直接頻率合成技術(shù)和鎖相環(huán)式頻率合成技術(shù)之后的第三代頻率合成技術(shù)，它的原理是在采樣頻率一定的條件下，通過控制兩次連
關(guān)鍵字： DDS AD9852

基于ARM的石英晶體測(cè)試系統(tǒng)中DDS信號(hào)源設(shè)計(jì)

摘要針對(duì)π網(wǎng)絡(luò)石英晶體參數(shù)測(cè)試系統(tǒng)，采用以STM32F103ZET6型ARM為MCU控制DDS產(chǎn)生激勵(lì)信號(hào)。該測(cè)試系統(tǒng)相對(duì)于傳統(tǒng)的PC機(jī)測(cè)試系統(tǒng)具有設(shè)備簡(jiǎn)單、操作方便，較之普通單片機(jī)測(cè)試系統(tǒng)又具有資源豐富、運(yùn)算速度更快等優(yōu)點(diǎn)。AD9852型DDS在ARM控制下能產(chǎn)生0～100 MHz掃頻信號(hào)，經(jīng)試驗(yàn)數(shù)據(jù)分析得到信號(hào)精度達(dá)到0.5×10-6，基本滿足設(shè)計(jì)要求。該系統(tǒng)將以其小巧、快速、操作方便、等優(yōu)點(diǎn)被廣泛采用。關(guān)鍵詞石英晶體;DDS;AD9852;STM32F103ZET6 產(chǎn)生
關(guān)鍵字： ARM DDS

一款基于FPGA和DDS的數(shù)字調(diào)制信號(hào)發(fā)生器設(shè)計(jì)

摘要：為了提高數(shù)字調(diào)制信號(hào)發(fā)生器的頻率準(zhǔn)確度和穩(wěn)定度，并使其相關(guān)技術(shù)參數(shù)靈活可調(diào)，提出了基于FPGA和DDS技術(shù)的數(shù)字調(diào)制信號(hào)發(fā)生器設(shè)計(jì)方法。利用Matlab/Simulink、DSP Builder、QuartusⅡ3個(gè)工具軟件，進(jìn)行基本DDS建模，然后在DDS模塊的基礎(chǔ)上，通過單片機(jī)等電路組成的控制單元的邏輯控制作用，根據(jù)通信系統(tǒng)中數(shù)字調(diào)制方式的基本原理，設(shè)計(jì)并實(shí)現(xiàn)了數(shù)字調(diào)制信號(hào)發(fā)生器，從而實(shí)現(xiàn)二進(jìn)制頻移鍵控(2FSK)、二進(jìn)制相移鍵控(2PSK)和二進(jìn)制幅移鍵控(2ASK)3種基本的二進(jìn)制數(shù)字調(diào)制。
關(guān)鍵字： FPGA DDS