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EEPW首頁 >> 主題列表 >> 時序仿真

基于VHDL的旋轉(zhuǎn)編碼器接口電路的實現(xiàn)

  • 用VHDL語言設計的增量式旋轉(zhuǎn)編碼器接口電路，實現(xiàn)了四倍頻、雙向計數(shù)的功能以及與單片機的接口。給出了在MAX Plus II環(huán)境下的VHDL源代碼和時序仿真結(jié)果。本設計在角度測量、位移測量和高度測量等方面有廣泛的應用價值。
  • 關鍵字： 旋轉(zhuǎn)編碼器  VHDL  時序仿真  

FPGA系統(tǒng)設計的仿真驗證之： 功能仿真和時序仿真的區(qū)別和實現(xiàn)方法

  • 這里我們使用一個波形發(fā)生器作為例子，來說明如何使用Modelsim對Quartus II生成的IP Core和相應的HDL文件進行功能仿真和時序仿真。這個例子里面使用到了由Quartus II生成的一個片上ROM存儲單元。這種存儲單元和RAM一樣，都是基本的FPGA片上存儲單元，在以后的設計里面會經(jīng)常使用到。
  • 關鍵字： 仿真驗證  功能仿真  FPGA  時序仿真  

基于CPLD及鎢錸熱電偶溫度傳感器的爆炸場溫度動態(tài)測試

  • 為了測量爆炸場等惡劣環(huán)境下溫度的動態(tài)變化,分析炸藥或相關彈藥的爆炸參數(shù),設計了基于CPLD的低功耗溫度存儲式測試系統(tǒng);運用鎢錸熱電偶溫度傳感器匹配先進的電源管理模塊,并結(jié)合動態(tài)存儲測試技術,能夠應用于環(huán)境條件比較差的惡劣環(huán)境中,在可靠可信、微功耗的基礎上能得到較好的實驗數(shù)據(jù)。
  • 關鍵字： 時序仿真  溫度測試  CPLD  

Modelsim的功能仿真和時序仿真

  • FPGA 設計流程包括設計輸入，仿真，綜合，生成，板級驗證等很多階段。在整個設計流程中，完成設計輸入并成功進行編譯僅能說明設計符合一定的語法規(guī)范，并不能說明設計功能的正確性，這時就需要通過仿真對設計進行驗證
  • 關鍵字： Modelsim  功能仿真  時序仿真    

基于CPLD器件的單穩(wěn)態(tài)脈沖展電路

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時序仿真介紹

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