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SDH、同步以太網(wǎng)設(shè)備時鐘的高效率實現(xiàn)方法
- SDH、同步以太網(wǎng)設(shè)備時鐘的高效率實現(xiàn)方法,本文介紹幾種類型的SDH、同步以太網(wǎng)等同步設(shè)備時鐘的器件設(shè)計方案,比較它們在易用性、綜合成本等方面的差異。指出采用模塊化的設(shè)計理念是高效率地完成包括設(shè)計和生產(chǎn)兩個方面內(nèi)容的產(chǎn)品實現(xiàn)之最佳途徑。這是專業(yè)化分工的必然趨勢,同時也符合通信設(shè)備制造商希望提高產(chǎn)品質(zhì)量、降低產(chǎn)品成本、加快上市時間的要求。
- 關(guān)鍵字: 高效率 實現(xiàn) 方法 時鐘 設(shè)備 同步 以太網(wǎng) SDH
微處理器內(nèi)核電壓的調(diào)整方法及電壓轉(zhuǎn)變時間設(shè)定
- 優(yōu)化電子產(chǎn)品微處理器電源管理對延長電池使用時間十分重要,MAX1586A、MAX1586B和MAX1587A系列電源管理器件針對X-Scale微處理器進行了優(yōu)化,利用簡單的外圍線路就可調(diào)高CPU內(nèi)核電壓以達到CPU對于輸出電壓的要求,適合更高工作頻率的CPU。本文對CPU內(nèi)核電壓轉(zhuǎn)變時間控制、調(diào)高輸出電壓的方式以及改變后CPU內(nèi)核電壓轉(zhuǎn)變時間的變化進行了詳細推導(dǎo)。
- 關(guān)鍵字: 電壓 時間 設(shè)定 轉(zhuǎn)變 調(diào)整 內(nèi)核 微處理器 方法
基于FPGA的迭代層析重建中的小數(shù)處理方法
- 基于FPGA的迭代層析重建中的小數(shù)處理方法,發(fā)射光譜層析(EST)技術(shù)是一種不干擾原待測場分布的測量診斷技術(shù),他在熱物理量測試、等離子體診斷等方面顯示出了極大的優(yōu)越性,尤其是在場分布測量方面,幾乎是其他方法不可替代的,是測量三維流場內(nèi)部物理量分布的一種常用方法。
傳統(tǒng)的層析重建技術(shù),通常是利用軟件編程在計算機上直接完成,這要花費很長的時間,無法滿足實時重建時對速度的要求,現(xiàn)在已有研究者開始著手研究在硬件(例如FPGA和DSP)上來實現(xiàn)層析重建技術(shù),例如:在FPGA上實現(xiàn)ART算法。但 - 關(guān)鍵字: 處理 方法 小數(shù) 重建 FPGA 基于
提高電路檢測質(zhì)量的一種方法
- 觸發(fā)決定了示波器何時開始采集數(shù)據(jù)和顯示波形。一旦觸發(fā)被正確設(shè)定,它就可以將不穩(wěn)定的顯示轉(zhuǎn)換成有意義的波形。在實際工作中,很多工程師通常把示波器的觸發(fā)功能視為“一定的”,認為他們一直使用的邊沿和毛刺觸發(fā)是足夠的,以前在評估示波器時,觸發(fā)指標也很少被放在優(yōu)先考慮的位置上。事實上,隨著技術(shù)的不斷發(fā)展,多功能應(yīng)用對于通用測試測量儀器示波器的要求也越來越高,為有效地完成實際工作,觸發(fā)靈敏度已經(jīng)成為目前示波器的主要參考指標。
- 關(guān)鍵字: 電路檢測 質(zhì)量 方法
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