解析高速ADC和DAC與FPGA的配合使用
通常情況下,這些數(shù)字接口采用的是并行LVDS總線,這樣它們會(huì)占用許多的FPGA I/O管腳,但是,并行接口的延遲最小,并且由于它們使用差分信號(hào)傳遞方式,也可以降低輻射噪聲,這在高性能系統(tǒng)中是非常重要的。
本文引用地址:http://m.ptau.cn/article/256789.htm收到FPGA發(fā)出的4個(gè)數(shù)據(jù)流,你可能想知道在FPGA內(nèi)部是如何處理數(shù)據(jù)的,在許多應(yīng)用中,包括通信處理器和射電天文,都使用的一個(gè)常用的方法是使用組合或者分離的FFT結(jié)構(gòu),如下面兩個(gè)圖所示:

使用4個(gè)128點(diǎn)的FFT流水線,加上旋轉(zhuǎn)因子和1個(gè)并行4點(diǎn)FFT,組合成512點(diǎn)的FFT

分離512點(diǎn)FFT,與組合FFT相反。與組合FFT不同的是,在前兩個(gè)階段,對(duì)高速輸入有一個(gè)重組的操作
因?yàn)檫@些真實(shí)的數(shù)據(jù)樣本,你將需要尋找一個(gè)優(yōu)化的方法以便于在FFT結(jié)構(gòu)中對(duì)這些數(shù)據(jù)進(jìn)行處理,高效的、大FFT的實(shí)現(xiàn)是一個(gè)復(fù)雜的研究領(lǐng)域,但是在FFT之前,許多應(yīng)用使用加權(quán)疊接相加(WOLA)結(jié)構(gòu)來改善頻譜泄漏。下面兩個(gè)圖顯示了使用一個(gè)矩形窗口的普通FFT和使用WOLA的FFT的行為對(duì)比:

使用普通FFT矩形窗口的相鄰信道

使用WOLA方法的相鄰信道,顯示了更少的頻譜泄漏
然后,根據(jù)應(yīng)用的需求,對(duì)這些合成的FFT數(shù)據(jù)進(jìn)行后處理。
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