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應(yīng)用EDA仿真技術(shù)解決FPGA設(shè)計(jì)開發(fā)中故障的方法

作者: 時(shí)間:2010-11-14 來源:網(wǎng)絡(luò) 收藏

  針對(duì)這三個(gè)問題,筆者提出如下想法:

  雖然定位具體的出錯(cuò)信號(hào)很困難,但是定位是哪個(gè)模塊出錯(cuò)很容易,在bug出現(xiàn)的時(shí)候我們可以抓出這個(gè)模塊的全部輸入信號(hào),考慮是否可以利用這些信號(hào)在仿真環(huán)境下重建bug出現(xiàn)的條件,利用仿真環(huán)境具體定位錯(cuò)誤信號(hào)的位置。

  定位好錯(cuò)誤信號(hào)的具體位置后,修改代碼,再用相同的條件進(jìn)行仿真。這樣可以通過對(duì)修改前后輸出數(shù)據(jù)的對(duì)比,很直觀的驗(yàn)證修改是否成功,從而在修改成功后只需編譯一次即可,節(jié)省時(shí)間。

  上板后bug不復(fù)現(xiàn)也可以排除是由于極端情況很難滿足造成的,去除了后顧之憂,徹底解決了故障。

  仿真解決故障的方法

  通過對(duì)這個(gè)異步FIFO問題的解決,可以證明這種通過所抓信號(hào)建立bug存在條件,定位、清除bug的方法是可行的。步驟如下:

 ?、賹ug出現(xiàn)時(shí)SignalTap抓的信號(hào)保存成文檔文件

  Quartus II 平臺(tái)用SignalTap抓到信號(hào)的界面如圖2所示。

應(yīng)用EDA仿真技術(shù)解決FPGA設(shè)計(jì)開發(fā)中故障的方法

  圖2 SignalTap抓信號(hào)界面

  在信號(hào)名稱上單擊右鍵,選擇圖2所示Create SignalTap II List File選項(xiàng),生成如圖3格式界面。

應(yīng)用EDA仿真技術(shù)解決FPGA設(shè)計(jì)開發(fā)中故障的方法

  圖3 SignalTap II List File界面

  圖3中界面上半部分顯示的是list對(duì)信號(hào)個(gè)數(shù)及信號(hào)名的描述,下半部分是采樣點(diǎn)所對(duì)應(yīng)的信號(hào)值,帶h的表示是十六進(jìn)制數(shù)值。



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