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基于FPGA的WALLACE TREE乘法器設(shè)計

作者: 時間:2011-11-16 來源:網(wǎng)絡(luò) 收藏

下面對2個3:2 CSA壓縮器合并成一個6:4壓縮器單元運算邏輯做理論推導(dǎo),其中:
,形成一個直通電路。

本文引用地址:http://m.ptau.cn/article/190974.htm

e.JPG


從圖3可以看出, 的6:4壓縮器單元只用一個slice就可以實現(xiàn)。而幾乎所有Xilinx的器件內(nèi)部slice結(jié)構(gòu)都類似,因此該6:4壓縮器在基本的器件中都可以通過此手動編輯方法實現(xiàn),形成一個可供頂層邏輯調(diào)用的硬宏模塊。



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