基于FPGA的多功能頻率計的設(shè)計與實現(xiàn)
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4 MC8051 IP Core軟件設(shè)計流程
系統(tǒng)軟件設(shè)計流程如圖11所示。
中斷服務(wù)子程序如圖12所示。
5 結(jié)論
文中采用Altera的cyclone II系列的EP2C8Q208C8這款FPGA芯片。設(shè)計中使用了Verilog語言對各個模塊的描述設(shè)計。文中提出的數(shù)字頻率計設(shè)計方案采用等精度的測量算法，以先進的FPGA可編程邏輯器件作為核心控制及運算電路單元可達到很高的測量精度要求，8051 IP Core嵌入到FPGA芯片系統(tǒng)，與測頻模塊共用同一個FPGA芯片，和傳統(tǒng)的頻率計相比大大減小了電路板的尺寸，同時增加了系統(tǒng)的可靠性、設(shè)計靈活性和可更改性。實現(xiàn)了數(shù)字系統(tǒng)的軟件化。加入LCD液晶顯示，使測量效果更加直觀。
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